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Fehlersuche
Schaltung an? Liegen die richtigen Signale an den Zwischenpunkten der Schaltung an? Sind Logikpegel sauber LOW und HIGH? Wenn nein, dann sind oft mehrere Ausgänge gleichzeitig auf einem Bus aktiv und ziehen in verschiedene Richtungen (Low und High). Oder Die Ausgänge sind zu schwach, um die Lasten zu treiben
um Zeitverhalten von Software zu messen, z.B. Interruptroutinen. Zum Beginn setzt man ein Pin auf HIGH, am Ende auf LOW, das kann man dann sehr einfach mit einem Oszilloskop messen Ebenfalls kann man mit so einem Testpin den Anfang eines speziellen Programmablaufs signalisieren, um ein Oszilloskop zu
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UHF-Modulator ALPS MDLP3W104A
Anstiegszeit der Datenleitungen ("SDA/SCL Rise Time") darf 300 ns nicht überschreiten beim Übergang von "Low" (1,5 V) auf "High" (3,0 V)! Ggf. mit dem Scope kontrollieren. Die Pull-Up-Widerstände können aber auch nicht beliebig klein gewählt werden, da dies zum einen die Stromaufnahme bei Buskommunikation
der SDA-Pin beim Senken von 15 mA bereits an die Grenze von 1,5 V hoch für den maximal zulässigen Low-Pegel. Bei 3 mA kann diese Spannung immer noch bis 1 V betragen! Hinzu kommt, dass das ALPS-Modul zusätzliche Serienwiderstände von 270 Ohm (R11; R12) in den I2C-Datenleitungen besitzt, die sich beim
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Avr-gcc Bugs
21621 Wrong / missing warning "skipping two-word instruction" 2.29.x 21849 Locate .progmemx.* at a higher address 2.29.x 21683 Support __gcc_isr pseudo-instruction 2.29 21583 Move .jumptables to a higher address 2.29 21569 Merge avr.sc and avrtiny.sc 2.29 21472 Add new emulation for ATtiny416 et al. (don't
Support ACCUMULATE_OUTGOING_ARGS 4.7.0 50775 Register allocator sets up frame and frame pointer with low register pressure 4.7.0, ra 50616 ICE: lto1.exe: invalid resolution in the resolution file 4.7.0, lto, mingw32 50566 Add support for better logging by means of -mlog= 4.7.0 50465 Use insn attribute
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STM32
Übersicht über alle Familien und Serien findest du auf der Seite STM32 32-bit Arm Cortex MCUs. Ultra Low Power Familie, optimiert auf geringe Stromaufnahme, insbesondere im Stop Modus STM32L0 (2014) ARM Cortex M0+ bis 32 MHz - mit EEPROM STM32L1 (2010) ARM Cortex M3 bis 32 MHz - mit EEPROM STM32U0 (2024
FLASH der stm32f1x laut Datenblatt nur für 10000 Schreibvorgänge ausgelegt ist, kann mittels BOOT0 (High) und BOOT1 (High) auch aus dem zuvor mit dem Debugger (JTAG/SWD) beschriebenen SRAM booten. Hierbei gilt zu beachten: VTOR auf die NVIC Tabelle im SRAM vor dem auslösen des ersten Interrupts remappen
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FPGA
50MHz x 16 Bit für die Daten. Ab diesem Punkt ist dann wieder ein schneller softcore einsetzbar. High-Speed-USB. Für die Übersetzung auf den immer schnelleren USB-Bus (inzwischen bis 5Gb Bandbreite!) stehen Chips zur Verfügung, die sich in vergleichsweise einfacher Weise ansteuern lassen. Eine passende
Boards - Zusammenstellung günstiger FPGA Boards unter 100$ Ein Vortrag, auf Englisch: General Purpose, Low Power Supercomputing Using Reconfiguration Logic - FPGA-Projekte, Opensource, jeder kann seine Eigenen einstellen und an anderen mitarbeiten. U.a. gibt es verschiedene CPUs für FPGAs. Projekt "FDIL
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WordClock mit WS2812
Nachbar-Pin ("0") angebracht werden. Beim Nucleo-Board wird der Pin BOOT0 bereits per 10k Pulldown auf Low-Pegel gezogen. Hier kann der ESP-Pin GPIO16 (ab Version 2.6.0: GPIO4) direkt ohne zusätzlichen Pulldown an BOOT0 angeschlossen werden. Zu beachten ist hier lediglich, dass kein Jumper auf Pin5-7 von
Anzeige-Logik und des MCURSES-Monitors auf dsp.c und monitor.c Aufteilung der ESP8266-Routinen auf esp8266.c (low-level) und timeserver.c (high-level) Diverse Optimierungen - u.a. durch Einsatz von uint_fast8_t Diverse Bugfixes STM32 Version 0.7.1. Portierung der Software auf STM32F411RE Nucleo-Board STM32 Version