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LVDS-Signale messen, wie?
prüfen, ob Setup- und Holdzeiten überhaupt stimmern und wie die Signale ganz allgemein aussehen (Augendiagramm). Damit kommt man schon mal SEHR weit. Die reine Logik kann man auch IM FPGA messen, Chipscope & Co lassen grüßen.
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interne differentielle Signale
eedbacksysteme für blinde Hunde? Das ist mit den "Augen" gemeint: https://de.wikipedia.org/wiki/Augendiagramm
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Differentielle Leitung zu Single Ended Leitung umwandeln
irgendwelche Skews macht. Warum machst du die Messung nicht zweistufig. Erster Schritt: Augendiagramm jedes LVDS Kanals ermitteln. Wenn da die Augen gut sind, dann kannst du davon ausgehen, dass die Phase zwischen LVDS+ und LVDS- Null ist. Wenn das bei allen Kanälen zutrifft, dann vergleichst
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Qualität CAN Analog Digital
ADC: Auflösung Genauigkeit Referenzquelle CAN: Augendiagramm o.ä. Was hast du vor? Es gibt eigentlich keine ICs mit "schlechten" I/Os. Entweder die passen zu deiner Spec, oder eben nicht. Wenn sie die Specs vom Datenblatt nicht einhalten ist das Teil
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2,4GHz Bandsperre
"sehr hohe" Dämpfung haben, aber so hoch das in der nachgeschalteten VSA - Software sich das Augendiagramm schließt (Auge muss nicht gänzlich geschlossen sein).
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Verständnissfrage Digitaloszilloskop
durch das nachgebildete Nachleuchten statistische Eigenschaften des Signals darstellen (z.B. Augendiagramm). MfG Falk
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2 Spartans verbinden, welcher IO Standard
das Layout nicht) besitzen einfach eine niedrige Störfestigkeit. Da hilft es nur die Größe des Augendiagramms aufzureißen - mit Schwellenwerten (low/high) die möglichst weit auseinander liegen. Die 24mA sind nicht notwendig, ich betreibe meine 400MBit/s (DDR) mit 2mA ohne Probleme. Du hast ja pro Leitung
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RS485 (Modbus Protokoll) mit mehreren Slaves
Wissenschaft draus machen. Man kann natürlich auch damit anfangen, dann aber sollte man sich auch mit Augendiagrammen beschäftigen.
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FPGA Clock Verteilung
Pfeile: > Input-Terminierungen? Die Farben der Pfeile beziehen sich auf die Farben der Augendiagramme aus einer Hyperlynxsimulation an dieser Stelle. Wird so in der verlinkten Appnote aus der auch, der Screenshoot stammt. In der Appnote werden die Auswirkungen der Terminierungsoptionen bei Xilinx
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Zulässige kapazitive Belastung für Datenübertragungsleitungen?
googel mal unter "Augendiagramm". Mit einem Oszi kannst du dann die Übertragungsstrecke beurteilen. Grüsse
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Playstation2 Konsole - was ist defekt??
Oszi. Dann gibt es irgendwo auf der Platine einen Meßpunkt, wo du bei eingelegter CD/DVD ein Augendiagramm aufzeichnen kannst, und auf maximale Signalqualität justierst. Den Rest sollte Google dir erklären.
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Keine RS232 Kommunikation bei CPU-Taktraten über 4 MHz
andere Zeichen erkannt werden. Mit oszi auch im Wechsel mit 0xf0, für ein relativ perfektes Augendiagramm bei Trigger auf Startflanke.
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Netzwerk auf Cat5 prüfen
Augendiagramm messen (lassen).
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Routing differentiell High-Speed Versatz
Der Kehrwert davon sind 140 GHz, d.h. bis ca. 15 GHz sollte das im Augendiagramm kaum etwas ausmachen (ein Versatz um 1/10 der Symbollänge würde mich jetzt nicht unruhig schlafen lassen).
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Verschiedene USB Spannungen (Vcc & GND) schalten
welche > bei den Augendiagrammmessungen sehr schlechte Werte erziehlt hatte. Was hat das Augendiagramm mit den Versorgungsleitungen zu tun? Das ist für die Datenleitungen …
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Impedanzmessung an Leiterplatten
dass da nichts mehr bei herum kommt. Messen kann man die Signalintegrität mit sogenannten Augendiagrammen (Danach kannst du gut googeln). Dazu nimmst du ein schnelles Oszilloskop und klemmst einen Tastkopf an die n und einen an die p Leitung an (besser ist natürlich ein dedizierter Impedanzmesskopf
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RS232 vs CAN, ungeschirmt nicht verdrillt
Gleichspannungsstörungen > 1V (GND ...) * D) SW-Fehler A und B mit dem Oszi anschauen ("Augendiagramm"). Für C das Oszi im Singlebetrieb triggern lassen über Nacht. (Sollte es C sein, ein Stück Lichtleiter zwischenschalten, gibt es als fertige Wandler) Zudem mit Diagnose feststellen, was verloren
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CAN Bus ohne verdrillte Leitungen
problematisch. Die Signalqualität misst man besser, anstatt zu vermuten. Stichworte: Oszilloskop, Augendiagramm
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AVR - Taktfrequenz für Seriell ohne Handshake
. Ein langes Kabel verändert nicht die Frequenz, bestenfalls die Flankensteilheit oder das Augendiagramm. > Aus dem Bauch heraus schätze ich, dass auf Modulen mit USB-UART > insgesamt bis zu 9% Abweichung noch funktionieren können Genau! Solche Bauchgefühlsexperten brauchen wir! Echte
Ein langes Kabel verändert nicht die Frequenz, bestenfalls die > Flankensteilheit oder das Augendiagramm. Korrekt. Es beeinträchtigt damit allerdings die Erkennung des optimalen Zeitpunktes zum Sampeln der Bits. Ich muss meine 9% auf die Hälfte korrigieren (4,5%). Ich hatte nicht berücksichtigt
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Impedanz: Unterschiedliche Leiterbahnbreiten oder 60 statt 50 Impedanz
liest ein Muster aus, z.B. 1010... dann hast du auch in den Daten den Takt. Beim Aufzeichnen des Augendiagrammes macht man es ja ähnlich. Man schaut sich die Datenleitungen eine gewisse Anzahl von Taktzyklen an und schreibt die Signalformen immer übereinander. Je höher die Freuqenz, destor kleiner das Auge
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Protokoll für Kommunikation zwischen zwei FPGAs
bei 5GBit/s und selbst entworfener Platine. Selbst über PCIe Kabel gabs keine Fehler und das Augendiagramm war fast maximal offen. Das läuft schon sehr robust. Mit gleichem Ref-Takt für beide Seiten ersparst du dir die Clock Correction, ist aber auch nicht sooo wild, bei Xilinx machen das die Transceiver
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Uart Terminal Monitor open source
etc zu analysieren. Was man da braucht: - Pegel - zeitliche analysen der Reserven (quasi Augendiagramme) - Zeit zwischen den Zeichen, Zeitstempel der Startzeichen Wie andere schon sagten: super dankbares Projekt zum selber bauen. Als Open source eher eine Handy/Tablet/PC-app mit Standard-UART
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"Livebild" bei digitalen Oszilloskopen
verhält sich wie das gezeigte Hameg Richtig so. Kein Mensch auf dieser Erde braucht wfm/s, Augendiagramme, GHz-Bandbreiten und all so ein unnützes Geraffel. Hauptsache das Scope beherrscht Rollmodus nach Art eines Hamegs 203, denn das ist die tagtägliche Killeranwendung.
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USB Input/Output Error mit Kondensator beheben
haben einen Wellenwiderstand von 90 Ohm. Dinge, die dein Kabel nicht hat. Dafür hätte das Augendiagramm vermutlich ein kleines Tränchen. Andreas S. schrieb im Beitrag #7449325: > Offenbar hast Du irgendein "Sonderkabel" > geschlachtet. Ich tippe auf copper-clad aluminum. Also billigstes
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Braucht man überhaupt ein Oszilloskop oder was brauche ich überhaupt?
aber wenig am Datenbus des PC, der I2C Schnittstelle oder Ethernet, wenn auch beim CD-Player das Augendiagramm was aussagt ohne die einzelne Bits zu zeigen. Einfache Schaltungen funktionieren aber auch im LTSpice Simulator, und da kann man die Kurvenverläufe auf dem Bildschirm sehen. Bei schwierigen
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Aufwand PCI express mit Virtex 5?
Magma Box soll in erster Linie dazu dienen, das Cabled PCIe zu verstshen. Signalspiel anschauen, Augendiagramme, verschiedene Kabellängen....in das Messgerät an sich kommt eine Platine, die den PEX8311 und den PCIe Cable Redriver gleich on board hat. Vorne raus nur der Molex Stecker für das x1 PCIe Kabel
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Verifizierung
Oszilloskope anerkannte Messmittel, wenn es um Signalintegrität geht. Ganz herausragend ist z.B. das "Augendiagramm", mit dem die Signalqualität von Hochgeschwindigkeitsbussen geprüft wird. Daisy D. schrieb im Beitrag #7192189: > Wie macht ihr so etwas? 1. Die Signalintegrität sicherstellen: sieht jedes
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Suche Osziloskop für Anfänger
bekommen, was nun gesendet wurde. Für die Signalform reicht ja erst mal jedes mittelmäßige Oszi, Augendiagramm wird damit zwar nix, aber für einen groben Überblick reicht das. Von den USB Dingern halte ich persönlich nicht viel, aber das ist sicher Geschmackssache. Bei den Artikeln (linke Spalte) sollten
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USB 2.0 Design-Rules
man die je nach Layout auch weglassen. Das Optimum kann man sowieso nur bestimmen, wenn man ein Augendiagramm aufnimmt und dafür fehlt den meisten das Equipment - ist aber auch fast nie im Hobby-Bereich notwendig.
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byzantinische Takterzeugung
Beschreibumg sind nicht so gut. Aber Bit-Fehler, Timing-Fehler in der App. (Bit Legastheniker ) Das Augendiagramm ()()()()() wurde erfunden um solche Metha-Stable Fehler zu finden. Is all Digital ... No its "Analooooog" you see via a Clock Modell. Die Prüf-Experten haben uns den Externen Quarz beharkt
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Datenleitungen USB und SATA bei zweilagiger Platine: Standardempfehlungen?
klappt, muss man probieren und wenn möglich mit einem TDR, Netzwerkanalysator oder schnellen Oszi (Augendiagramm) messen.
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DDR3 und Abblockkondensatoren
1GHz. Bei 800 Mbit/s hat man keine "Rechtecksignale" mehr sondern eher "eckige" Sinüsse, aka [[Augendiagramm]]. >Der wird nicht ein großer nicht mehrere kleine ersetzen können. Jain, in der Schaltung sind schon noch ein paar mehr 100nF Kondensatoren drin. Auf jeden Fall keine klassischen Alu- oder
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Length Matching - SDR Ram
Wenn man allerdings annimmt dass die Flanken sehr flach sind und sich gerade so in der Mitte vom Augendiagramm der Scheitelwert ausbildet, können Fehler also "schon" bei ca 2nS auftreten. Mit der These, dass sich das Signal mit 1ns/150mm ausbreitet habe ich also einen maximal tolerierten Längenunterschied
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ESP32 C3 Wroom - USB Verschaltung
dienen als Impedanzanpassung und zur Regulierung der Flankensteilheit. Aber da man selten ein Augendiagramm bei sowas anfertigt, würde ich sagen: Design sie mit ein und bestücke sie. Wenn du Probleme hast, kannst du die Cs schnell entfernen und bei Bedarf auch noch die Widerstände durch 0R ersetzen.
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USB Kabellänge 7,5 m - wie möglich?
des Spannungsabfalls über dem Kabel. Eine genau Analyse geht über die Protokollierung des Augendiagramms (Up- und Downstream getrennt). Diese wird von verschieden Oszi-Anbietern auch als Messplatz verkauft. Es gibt für das o. g. Problem Lösungen mit anderen Übertragungstechniken, z. B. Lichtwellenleiter
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[V] Agilent 86100A Oszilloskop/DCA >50GHz mit 20GHz elekt.+opt.
aktuellen Bussystemen im PC (USB 3, SATA, DDR4) zu machen braucht es schon solche Bandbreiten. Für Augendiagramme, Jitter uvm. tut es da auch ein schneller Sampler. Hinderlich wird dabei eher die fehlende Software für die Prüfung gemäß des jeweiligen Standards sein. Das Thema gab es ja kürzlich schon in
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FPGA Zukunft
internen tools nicht weit. Selbst mit IBERTs nicht. Aktuelle FPGAs können da auch das ganze Augendiagramm liefern. FPGA-Expert schrieb im Beitrag #7320360: > 2) immer mehr Personen das Wort "FPGA" mit SoC gleichsetzen: Ist auch noch nicht eindeutig. Ja, es gibt Mischlösungen als Hardware wie
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Oszi für USB 2.0 und PCIe 2.0 compliance testing
Um PCIe 2.0 ordentlich zu messen und die Augendiagramme zu bewerten reicht ein Oszi mit 6GHz BB vorne und hinten nicht. Das wird schon mit 1.1 knapp, sind ja immerhin schon 2,5GHz Signal. Hinzu kommen die sauteuren Proben für solche Frequenzen. Ich
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Filter schneller berechnen, aber wie ?
oszi geschaltet, bei dem man je nach Erhöhung der Ordnungszahl beobachten kann, wie sich das Augendiagramm schließt. Später wird dann ein Entzerrer zwischen Bit-Generator und Kanalmodell geschaltet und das ganze unter dem Praktikumsversuch "Entzerrung von Digitalsignalen zusammengefaßt. Meine Aufgabe
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Visualisierung im Code Composer Studio
Composer Studio kann man sich Speicherinhalte z. B. als Graphen über die Zeit darstellen lasse, Augendiagramme anfertigen usw. Gibt es auch eine Möglichkeit, sich einen zusammenhängenden Speicherbereich als Graustufenbild mit bestimmter Höhe und Breite darstellen zu lassen? Vielleicht fehlten mir bisher
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Layoutüberprüfung: Ethernet PHY
Bei den parallelen TXN,TXP,RXP,RXN gibts keine Probleme ESD-Schutz ist drin Simulierten Augendiagramm passt Ich lass übermorgen ne Prototypenplatine fertigen...
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SGMII: Signal Integrität (ETH-PHY DM83869)
nicht. Ich tippe hier auf einen grundlegenden Meßfehler. Du musst eigentlich ein gescheites [[Augendiagramm]] messen. Deine Bilder sind nur Gewitter. > Ich habe die Ethernet-Bandbreite gemessen, und ich erreiche 940 Mbit/s > (passt ganz gut, wenn man den overhead und 8b/10b kodierung noch > berücksicht
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Beurteilung Signalqualität 10Mbit 100Mbit Gbit Ethernet
habe ich in einer Vorlesung gehört, dass zur Beurteilung ,z.B. des Signal Rauschverhältnisses, Augendiagramme eingesetzt werden können. Welche Messgeräte kennt / verwendet ihr für diesen Zweck? (Bei Tektronix habe ich ein Oszilloskop gesehen, dass dessen mächtig ist) Welche weiteren Verfahren gibt es?
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Anpassung bei 10 MHz, Teil 2
Frequenz? Gar nichts ist daran tragsisch. Es sei denn das Teil strahlt wie eine Antenne oder dein Augendiagramm ist im Arsch. > Ich habe die Möglichkeit vor dem Koppelkondensator den Schaltungsteil > nach links anzupassen. Transformiere deine Last auf 50 Ohm und gut ist. Oder bau ein Dämpfungsglied
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Artikel
Benutzer:Engineer
Eingestellte Projekte: Projekt_VGA_Core_in_VHDL Eingestellte Artikel: Analog-IO mit digitalen Bausteinen Augendiagramm Bildsensor Dithering Digitale_Sinusfunktion (Auszug Facharbeit / Aufsatz) Digitale_Interpolation_bei_DA-Wandlung Digitaler_Zufallszahlengenerator_in_VHDL Digitaler_Rauschgenerator_im_FPGA Digitaler_LaPlace-Funktionsgenerator_im_FPGA
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HiFi Toslink-Kabel
soviel aus, siehe [[Wellenwiderstand]]. Und die meisten würden sich wundern, aus welchen miesen Augendiagrammen noch ein astreines Digitalsignal rekonstruiert werden kann. Gescheiter Empfänger vorrausgesetzt. > und anschließend durch einen nicht für HF geeigneten Übertrager >gequält, nur um anschließend
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Ethernet 10BASE-T Impedanzen, Spannungen, Leistungen
2.2 V and 2.8 V." In Abbildung 14.10 findet sich dann ein (vermutlich dazu passendes) Augendiagramm. Die dort eingetragene Spitzenspannung liegt aber gerade mal bei 1V. Es gibt keine Angabe, ob es sich um die Differenzspannung handelt, die betragsmäßige Spannung auf Rx+/Rx- oder
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Verbindungsleitung Digitalausgang 75 Ohm / 50 Ohm
spürbar. Mit entsprechender Meßtechnik sieht man bei solchen Kabeln gleich ein schlechteres Augendiagramm mit weniger weit geöffneten Augen bei ansonsten gleichen Bedingungen. > 2. Alternativ könnte ich auch ein Kabel basteln aud > 75-Ohm-Leitung-Meterware und zwei Cinch-Stecker. Dann hätte
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DDR2 Design mit Eagle?
(ich weiß nicht, ob es schon genannt wurde) Um das Augendiagramm bei den genannten Frequenzen aufzunehmen, benötigst Du zudem ein hochwertiges Oszilloskop. Und damit ist jetzt kein Gerät im unteren vierstelligen Bereich gemeint...
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EMV von Datenleitungen?
) Byte Daten pro Übertragung > sehe ich doch kein Land am Osziloskop oder? Mach halt ein Augendiagramm. Triggere auf beide Flanken, stell die Zeitbasis so ein, dass genau 1 Bit auf den Schirm passt. Dann schaltest du "Persist" oder wie auch immer das bei deinem Scope heißt ein und lässt das ein