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XILINX CPLD Programmer Problem
Hallo zusammen! Ich habe gerade mein XC9572-Programmer fertiggestellt. Den Schaltplan habe ich von loetstelle.de. Leider habe ich das selbe Problem: "iMPACT:923 - Can not find cable, check cable setup" Ich habe schon hier und da probiert
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XC9536 XL Quarz
Hi ! Ich verwende einen Quarzoszillator 50MHz / 5V. Die Eingänge sind 5V tolerant beim XC9572XL... Produkt bei Reichelt OSZI 50MHz, Gehäuse 14 DIL Damit müßtes Du keine Probleme kriegen! Gruss macke_a
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FPGA Einstieg ohne fertiges Board möglich?
ob ein einfaches cpld genügt (hört sich stark danach an). Das größte Xilinx-cpld bei Reichelt (XC9572XL im TQFP100-Gehäuse) kostet grade mal 5.30EUR, hat aber insgesamt nur 72IOs plus Clockeingänge, und wenn du noch ein paar Pins zusätzlich für den seriellen Ein/Ausgang brauchst... Die größeren Teile
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VHDL-Tristatebuffer will nicht
Hi, ich verwende einen XC9572 und der hat doch laut DB Tri-Buffer. Das asynchrone Gehühner gefällt mir auch nicht, hab aber noch nie einen Tri-Buffer verwendet und weiß nicht so wirklich wie ich das WR und RD Signal gleichzeitig
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CPLD kaputt ???
Hallo. Ich habe hier einen Xilinx XC9572-15 verwendet. Dieser zeigt aber ein äußerst merkwürdiges Verhalten. Versorgt wird er mit 5V. Programmiere ich ihn (mit iMPACT), so funktioniert dies einwandfrei. Auch verifizieren und löschen klappt
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Digikey Sammelbestellung
dazu noch: 25x 122-1388-ND (XC9572XL-10VQG64C)
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USB Speicher-Oszilloskop (Anfängerhilfe)
*adc: flash-adc, alles andere is sinnlos. *gal: is out, cpld is in. typ. zb xc9572xl q100, 72 i/o, 10ns, 100mhz max clock, bei reichelt 4,50eu - was willste mehr? *plat.: 4layer, naja, sollte mit 2 gehen, da alles schnelle smd auf einer seite is, andere ground plane. beim preis
*ingo genau den XC9572XL hatte ich auch im auge, bzw die 100pin version, wenn smd, dann ja auch schon egal, der hat genug io extra. den analog-in hab ich schon geplant, aber mit (s.o.) min 0,1v/div , das macht wesentlich
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CPLD XC9572 XL - in Eagle
Pins nicht vergessen! Übrigens falls du lesen kannst: https://www.cs.tcd.ie/Ross.Brennan/mystuff/XC9572_Datasheet.pdf Steht alles drin was man braucht.
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Spartan3 Betriebsspannung
eine Frage und würde mich über Antworten freuen. Seit längeren Programmiere ich die Xilinx XC9572 das haut auch schon ganz gut hin, seit ein paar Wochen habe ich mir ein Spartan Kit für 99Euro gekauft, aber nun möchte ich mir meine eigene Platine aufbauen mit einem Spartan3 XC3S400 und suche Spannungsregler
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Problem mit counter
Hallo, ich habe folgendes Problem. Ich möchte mit einem CPLD (XC9572) eine Frequenz (1MHz) mit einem 3 bit Zähler Teilen, um auf 125 kHz zu kommen. Die Frequenz muss natürlich symetrisch sein. Leider ist die An-Zeit etwas länger, so dass etwas mehr als 125 kHz rauskommen
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FPGA contra Mikrocontroller
wird es maximal ein CPLD Board. Ich haette ein Anfaengerboard zuverkaufen. Platine bestückt mit XC9572 PLCC , Laengsregler , Quarz und alle IO's auf Pinheader für 20 Euro. Bei interesse bitte meine Email Adresse nutzen. Gruß, Dirk
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ghdl = compiler&simulator?
dann in einen cpld/fpga reindrücken? wenn ja, kann mir jemand sagen, wie ich das z.b. bei nem xc9572 machen kann? hab jetzt schon sooo viel gegoogelt, doch nix dergleichen gefunden! thx tüddel
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VHDL-Simulator unter linux
kostenlosen Version schnarch langsam. Jetzt hatte ich genug Minuten auf 100 ms von einem kleinen (XC9572) Design Simuergebnisse zu warten (Verhaltens-Simu, nicht Timing) und hab die ISE 8.1.02 angeworfen. Da muss schon einiges geklickert werden bis es läuft. Insbesondere im Fenster links-oben ist auf
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Quarz an CPLD
es nochmal genau wissen bzw. ich finde den Beitrag nicht mehr. Und zwar : Hat jemand bei einem XC9572XL einen Quarz (12.288 MHz) angeschlossen und zum Schwingen (über einen Inverter) gebracht ? Ich weiß zwar das Xilinx bei den FPGAs (und auch tlw. CPLDs) keine Garantie darauf gibt das man mit einem
#Ich habe einen CPLD (oben besagter XC9572XL) zum laufen gebracht (lässt #sich also programmieren). Du hast wahrscheinlich über JTAG programmiert, das sagt nix ob der quarz wirklich schwingt. (Der quarz wird im design, nicht zum Programmieren
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ISE 7.1i ->Schematic ->Komisches UND-Verhalten + beim Counte
In meiner CPLD-Schaltung (auch mit XC9572XL) hatte ich das aelbe Problem. Habe dann die Schaltung soweit runtergebrochen, daß ein Eingang des PLD's direkt mit einem Ausgang verschaltet war. Ergebnis: Low am Eingang ergab High am Ausgang
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Wer "flasht" mir ein CPDL ???
upsss es ist ein Xilinx XC9572 in plcc84
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CPLD Programmieradapter
Spartan 3 Board beschäftigt und es gefällt mir echt gut. Jetzt würde ich gerne mal einen CPLD (XC9572XL) auf einer Lochraster Platine (PLCC44) ans laufen bringen (eine kleine Bastelei). Den Programmieradapter dazu möchte ich ebenfalls selber bauen, nach Möglichkeit so lowest cost wie gerade eben geht
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JTAG Programmierung mit Xilinx Impact Problem
ausgelesen, wenn ich z.B. die device Signatur auslesen will. Zudem ist das nur ein ganz banaler xc9572xl.... In der Fehlermeldung steht: [c]INFO:iMPACT:1209 - Testing for '0' at position 2.The Instruction capture of the device 1 does not match expected capture. INFO:iMPACT:1206 - Instruction Capture
Boundary-scan chain test failed . Please check tdi->tdo connection between device:'1' ( 'GENERATED_XC9572XL') and the cable .[/c] Ich meine aber, ausdrücklich mehrmals gelesen zu haben, daß man bei xilinx tdi-tdi und tdo-tdo direkt verbindet? Und nur zur Sicherheit: die *.bsd files sind die bitstreams
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GTS Pin beim XC9572XL
Hallo! Ich möchte über einen GTS Pin beim XC9572XL alle Ausgangspins deaktivieren. Im VHDL Programm habe ich den Pin "Deactivate" dafür definiert: Deactivate: in std_logic; Über "Edit Constraints" habe ich die folgende Zeile in die Constraints
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Xilinx CPLD XC9572XL
Hallo, vielleicht könnt ihr mir helfen, ich habe eine Platine auf der man einen CPLD XC9572XL (und div. andere CPLD's) programmieren kann zusammengebaut. Programmiert wird das ganze mit dem ISE WebPack von Xilinx (ver.7.1i) Jetzt mein Problem: wenn ich einen Schaltplan im Schematic eingebe
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Wie optimieren um weniger Produktterme zu bekommen?
Synthese etwas zu pushen. In meinem CPLD-Projekt für den 7-stelligen 200 MHz Frequenzzähler (1x XC9572 zu 99% voll) habe ich mit folgenden Parametern experimentiert: "Collapsing PTERM Limit" (z.B. 26) "Collapsing Input Limit" (z.B. 36) "Use Multilevel Logic Optimization" (ON) "Optimization Style
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Xilinx Spartan 3 - Grundbeschaltung
www.fpga-dev.de/beschreibung_xc2vx.htm schaltpläne sind da verfügbar. der fpga wir von einem flash über eine xc9572 konfiguriert. dabei kann man bis zu 16 programme speichern. programmieren geht über impact oder per usb. fals du den quelcode von den cpld der den flash ansteuert haben willst sag bescheid. mfg
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Probleme mit ISE Webpack
aber bei bislang zwei Rechnern nicht. Was läuft da falsch??? Wo könnte ich ein Beispiel für den XC9572 (84Pins) runterladen, das auf jeden Fall funktioniert? Sind bei mir vielleicht irgendwelche Einstelleungen falsch? Gruß, jörn
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CPLD XC9536 wird heiß ?
Hallo, ich hab auch ne Schaltung mit einem XC9572. Der wird bei mir auch 65 grad warm. 65 Grad kann man schon nicht mehr dauerhaft anfassen. Funktionieren tut er trotzdem einwandfrei. Bei meinem sind an den Ausgängen auch nur andere Ics dran, also
geschaltet. Unbenutzte pins ziehen strom je nach dem wie sie in der ise eingestellt wurden. Mein XC9572 wird höchstens lauwarm.
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Probleme mit der CLOCK
Moin, ich habe mir ein XC9572-Experimentierboard gebaut und dieses an Stelle des dort vorgesehenen NE555 mit 15 Hz mit einem 1 MHz Quarzoszillator versehen. Nun wird dieser Takt auf dem Layout über eine relativ weite Strecke geführt
schon relativ warm. Nachmessen mit einem Oszilloskop konnte ich leider bisher noch nicht. Ist der XC9572 denn sonst sehr anspruchsvoll beim Layout? Wie sind Eure Erfahrungen so? Gruß, Jörn
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Ein JTAG-Adapter für alle Spannungen
Hi, es gibt die Xilinx-Logikbausteine (Konkret: XC9572) in verschiedenen Varianten für verschiedene Spannungen (5V, 3.3V, 2.5V), aber bis jetzt habe ich bei den JTAG-Adaptern (zum selberbauen) noch keinen Hinweis darauf gesehen, für welche Typen die denn
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Wie viel passt in die FPGAs von Xilinx rein?
Um VGA-Signale zu erzeugen müsste ein XC9572(XL) ausreichen, für das eigentliche VGA-Timing reicht ein XC9536(XL). Für einen Prozessorkern benötigst du schon ein FPGA. Schreibe am Besten erst den Code und suche dann das FPGA oder CPLD aus, weil
verstehst du unter VGA-Timing im Unterschied zu "VGA-Signale" ? Nach meiner Erfahrung wird ein XC9572 für eine VGA sehr knapp. Für einen VGA Text Kontroller, der also im VRAM nur die ASCII+Color Bytes speichert und diese dann mit Hilfe einer Zeichentabelle anzeigt benötigte ich einen MAX7128S, sprich
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XC9536 pinkompatibel zum XC9572
Moin, einfach eine kurze Frage: Ist der XC9572 im PLCC44-Gehäuse pinkompatibel zum XC9572, so dass ich ihn einfach und ohne jede Änderung in einer Schaltung austauschen kann, wenn ich mehr Macrocells benötige? Gruß, Jörn
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Wie aussagekräftig ist die Timinganalyse
stelligen Frequenzzähler (multiplex, inkl. BCD-zu 7-Segment-Decoder und Zeitbasisteiler) in einem XC9572 zu realisieren und siehe da - mit einigen Tricks gings. Bei den Timing-Constraints kann man eigentlich alles vorgeben, was nötig ist, um es dem Fitter so einfach wie möglich zu machen. Wichtig
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Downloadkabel
der Homepage geben, wo ich den Bauplan für diese Downloadkabel und das Downloadprogramm für xilinx XC9572 CPLDs finde. Es ist so ein ganz einfaches Kabel für die LPTx Schnittstelle am Computer, auf der anderen Seite ist ein JTAG-Anschluss. Es enthält keine weiteren Bauteile. Ich ahb schon gegoogle, finds
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Wie überprüfen ob ein XC9536 einen Reset durchführt?
Hallo, ich habe Probleme mit einem XC9572. Der PLD ist in einer Schrittmotorsteuerung. Ab und zu gibt er ausgangszustände aus welche eigendlich nicht sein dürften. Ich habe jetzt die Vermutung das Störungen durch Schaltvorgänge auf der Platine es irgendwie bewirken das der XC9572 einen internen Reset durchführt. Wie kann ich überprüfen ob er dies tut. Im Webpack habe ich eine Option gesehen an der man einstellen kann ob alle Flip-Flops zu anfang low oder high sein sollen. Ist
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warum geht das nicht?
ok, jetzt hab ich den nächsten fehler :-( ich kann nix in den cpld (xc9572xl) laden :-( wenn ich was progen/erasen,... will, kommt diese fehlermeldung :-( ERROR:iMPACT:583 - '1': The idcode read from the device does not match the idcode in the bsdl File. INFO:iMPACT
wiederstand und dann error) nicht treiben sollte, sondern genau das gegenteil! :-( benutzen tue ich nen xc9572xl (xc9572xl pc44dmn0505 f1342903a 10c (genaue aufschrift)) unter xilinx webpack 7.1.0.3i
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wer kriegt soetwas in einem cpld hin?
logikbauteilen gebaut. dann könnte man das doch auch auf einen kleinen cpld, sagen wir XC9536 oder XC9572 unterkriegen, oder?
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CPLD und AVR Kombo (Logic Analyzer)
Dank! Ich hatte so etwas schon befürchtet. Die verfügbaren I/O waren auch der Grund zum Sprung vom XC9572 auf den CX95144. Momentan ist der Stand: * 2Stck 256k x 16 SRAM (synch/asnych steht noch nicht konkret fest wegen Preis/Verfügbarkeit). Dies benötigt ggf. 2 Adresszähler (odd/even) mit jeweils
XC9572 -> XC95144XLTQ144 -> XC95288XLTQ144 Evolution? XC95288XL10TQ144 288Macro 117I/O 10ns TQFP144 18,618 bei Darius.de Allerdings kommen wir langsam in FPGA Preis Regionen. Oder die synchronen
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XC9572 Timing Identifikation
Hallo, ich habe hier einen XC9572 PQ100AEM0025 vor mir liegen. Leider entspricht die Bezeichnung nicht dem wie bei Xilinx angegeben. Was für ein Timing ist das? 25ns gibt's anscheinend nicht. Gibt's irgendwo eine Tabelle, wo das
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Logic Analyzer bauen
weg, halte es für schwierig, die restliche Logik (Triggerung...) noch mit reinzuquetschen, ein XC9572 scheint mir das Minimum zu sein.
weg, halte es für schwierig, die restliche Logik (Triggerung...) >noch mit reinzuquetschen, ein XC9572 scheint mir das Minimum >zu sein Besser wäre es, 2 oder 3 XC9536 einzusetzen. Schließlich wird dieses Bauteil für EUR 1,50 bei eBay angeboten.
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Einteiger
ich meine natürlich den XC9572 und nicht den XC9272, den gibs genau so wenig wie die XC97.
xil_prodcat_product.jsp?title=design_kit interessant. Es ist mit einem XC2C256-7TQ144 CoolRunner-II CPLD und einem XC9572XL-10VQ44 CPLD bestückt und sieht so aus: http://www.xilinx.com/products/cr2/popups/designkit.jpg :) Es ist alles dabei, sogar ein JTAG Adapter und auf dem Board ist so viel Platz dass man viel Raum
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GAL für einsteiger
Cool-Runner von XILINX (Techn. übernommen von Philips?) benötigen ziemlich wenig Strom, ein klassischer XC9572 kann dagegen schon ziemlich "heizen", Beispiel: 7-stell. Frequenzzähler mit Zeitbasisteiler und BCD-7-Seg-Dec., Multiplexer im XC9572-15 (5V-Device) benötigt bei 200 MHz Eingangsfreq. ca. 160
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Sind Xilinx XC95xx Eingänge sehr empfindlich?
Hallo, ich hab eine Schrittmotorsteuerung mit nem XC9572 aufgebaut. Die Schrittweite wird über 3 Jumper eingestellt. Im XC9572 habe ich die Eingänge auf 3 Flip Flops gelegt. die Flip-Flops werden mit einem 4ten Eingang getaktet. Jetzt sollte es ja so sein
ausgangsseite der flip flops raus. Ich vermute das kommt irgendwie durch störungen die sich der XC9572 durch irgendwelche leitungen einfängt. der 5te eingang ist sogar fest mit 5Volt verbunden, allerdings über 20cm Freiflugleitung. Hat da schon mal jemand probleme mit gehabt das die eingänge jeden kleine
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Xilinx ngdbuild meldet logical net has no load, wo finden?
Hallo, ich bin grad an einem projekt mit nem Xilinx XC9572. Ich arbeite mit den Schmematics, leider nicht mit VHDL. Mein Schaltplan ist jetzt ca 10 DIN A0 Seiten groß, jetzt meldet ngdbulid das mein logical net 'N767' no load hat. Das bedeutet ja das irgendwo
schon drauf. Das mit den optimierungen abschalten klappt nicht. Dann passt es nicht mehr in den XC9572 rein, der optimiert mir schon ne menge weg denke ich. Ich werd wohl damit leben müssen. mfg Stefan
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Einstieg programmierbare Logik
Ok danke soweit, hat schon etwas geholfen, ich denke für einige Experimente ist der xc9572 vielleicht die richtige Wahl, den jtag Adapter nach dem xilinx pdf kann ich mir ja bauen. Es ist aber ein kleines Problem aufgetreten: Also ich habe jetzt einige Zeit google nach Datenblättern des
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Parallelport im EPP-Modus
EPP-Handshake macht, funktioniert zumindest in der vhdl-Simulation schon und wird vermutlich auf einem XC9572-cpld realisiert. Die Datenrate selbst (wohlgemerkt 1MBit/s, nicht MByte/s!, d.h 125kByte/s) sollte ja kein Problem sein, ich frage mich nur, ob ich mich darauf verlassen kann, dass die Daten kontinuierlich
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FPGA / CPLD - Quartus II
Frequenzzähler mit CPLD geeignet, schau mal auf www.dl1dsn.de , 7-stelliger Freq-Zähler 200 MHz mit XC9572 von XILINX, Platinen gibts auch welche, könnte ich rausfinden, wenns Dich interessiert, restliche Teile REICHELT. Das Design ist schon sehr trickreich (Source-Code auf der Webseite verfügbar) -
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xc9500, ps2
gegeben... und siehe da... er hat genau(meistens) das gemacht was er machen soll ich verwende den xc9572-15 also die langsame 15ns version... aber diese sollte doch dazu in der lage sein mit meinem 4mhz-takt zu funktionieren, oder? gruß marcel
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An I/O 3.3V statt 5V ?
Bsp. XC9572 Datenblatt : Voh min = 2.4V, mehr wird nicht garantiert Einfach einen Treiber oder Transistorstufe nachschalten, wenn das nicht reicht?!
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xilinx cpld vhdl, bad synchronous description
habe hier jetzt diesen jtag-programmer von xilinx (der mit den zwei HC125) zwei XC9536 und einen XC9572 (reichelt) und ... ... fragen: :) - was ist denn eine macrozelle? - kann ich im vhdl-code fest zuweißen welche pins meine einzelnen ports bekommen? und wenn ja, verringert das dann die leistung
größeren cpld/fpga? wenn ja, wo bekomme ich diese denn her? bei reichelt gibts nur den XC9536 und den XC9572... so... *g* ich hoffe dieser text ist einigermaßen verständlich und hab hoffentlich nix vergessen gruß marcel
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XC9572 (3.3V) Bekannte Fehler?
Coolrunnern, ist mir nicht bekannt, das soetwas passieren kann. Deshalb fiel mein Blick auf den Xilinx XC9572-XL (3.3V). Sind jemand Fehler bekannt (z.B. Versagen der Logikfunktion beim Booten oder im Betrieb) die auf das Bauteil zurückzuführen sind? Gruß Henrik
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8Bit Grafikkarte für µC
liegen brach und konnen noch für andere Dinge verwendet werden. Allerdings sind die Makrozellen vom XC9572 verbraucht. Also einen XC95108 verwenden. Ich werde wenn mein XC95108 da ist noch einen TextModus einführen. Mfg Ulrich
dargestellt. Allerdings benötigt man dann ein XC95108PC84(108 Makrozellen) der Pinkompatibel zum XC9572PC84(72Makrozellen) ist. Aber bis dahin kann es noch etwas dauern. Aber erst nach meinem Winterurlaub im April. Mfg Ulrich
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VGA Testbildgenerator
unter http://elm-chan.org/works/crtc/report.html ist in etwa was ich auch baue, halt nur mit einen XC9572 also eine Nummer kleiner aber mit den gleichen Funktionen, und halt mit Eagle Layout, und nicht mit ABLE sondern mit einer Schematic des CPLDs. Mfg Ulrich
Speicher ist aber kein Problem. Der Code für den Xilinx kommt in den nächsten Tagen. Es kann der XC9572 oder XC95108 benutzt werden. Als Speicher benutze ich Cache aus einem alten 486er Mainboard. Dieses Board diente mir bisher als Basis. Mfg Ulrich