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STM32H7: PH1-OSC_OUT als Clock für Ethernet verwenden?
LAN8742A: "The device can accept either a 25 MHz crystal or a 25 MHz single-ended clock oscillator (±50ppm) input." Wie bekommt man diese Genauigkeit mit den internen Oszillatoren und PLLs eines H7 ohne
Chris schrieb im Beitrag #7907390: > lwIP klappt problemlos mit dem LAN8742A auf dem STM32H7. _Was_ hast du denn an Funktionen überprüft?
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LAN8742A-CZ-TR: RX- und TX-Leitungen kreuzen
Hi, ich versuche gerade, einen Ethernetanschluss mit einem LAN8742A zu realisieren. Mein Problem jetzt: Die (symmetrischen) Leitungen RX and TX vom Netzwerkstecker zum LAN8742A kreuzen sich! Keine Ahnung, warum das genau passiert, aber ich vermute, das liegt daran
Chris schrieb im Beitrag #7894705: > ich versuche gerade, einen Ethernetanschluss mit einem LAN8742A zu > realisieren. Das Ding ist für 100 MBit-Ethernet. > Mein Problem jetzt: Die (symmetrischen) Leitungen RX and TX > vom Netzwerkstecker zum LAN8742A kreuzen sich! Kein Problem, nimm
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Umstieg auf 6 Lagen? Welche Signale wohin?
bestanden. Layer 2 (GND) und Layer3 (+3V3) sind ausgeblendet. Was jetzt neu hinzukommt ist ein LAN8742A Ethernet PHY, welcher über RMII mit dem STM kommunizieren soll. -> Im Bild der Bereich mit den Airwires. Grundsätzlich bekomme ich die Leitungen vom RMII Interface nicht mehr sauber - damit
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Ethernet mit STM32F767ZI, LAN8742a und BEL (08B0-1B1T-36-F)
sich vom PHY zum MagJack kreuzen würden habe ich RX+- mit TX+- paarweise getauscht. Das sollte lt. LAN8742A mit Auto-MDIX funktionieren. Den PHY-Reset Pin habe ich auf den MCU GPIO gelegt. Mein Signale sehen für meinen Wissensstand sehr gut aus (siehe Bilder bei Aushandlung 100Mbit): - Gutes 50MHz
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Schaltplan eines USB-Controllers mit LAN8742A
, C21, 100nF, C22, 5.6uF, GND, FLAG, PHY_VDDA, C36, 10uF, C37, 100nF, C38, 100nF, C39, Decoupling, LAN8742A_VDDA, US, USBIC6-45CB, MagJack, TX_P, TX_N, RX_P, RX_N, RMI4_TX_P, RMI4_TX_N, RMI4_RX_P, RMI4_RX_N, RMI4_TX_END, RMI4_MDIO, RMI4_MDC, RMI4_REFCLK, PHY_RST, RMI4_MDIO, RMI4_MDC, RMI4_REFCLK, XTAL1
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Frage zu RMII Ethernet Switch
Inbetrieb zu nehmen. Die Software für die Ethernet Kommunikation wurde auf dem STM32H7 Nucleo mit einem LAN8742A bereits erfolgreich getestet. Nun steht die Inbetriebnahme mit dem KSZ8873RLL an. Ein Link von meinem Laptop zum Switch IC kommt zustande, den ganzen ARP Traffic etc. sehe ich auch auf den RXD
soll etc etc. Vieles findest sich in den zweiten 16 Registern, die herstellerspezifisch sind. Der LAN8742A kommt ursprünglich von SMSC, der KSZ8873 von Micrel. Beide Firmen wurden von Microchip übernommen, aber die technischen Unterschiede bleiben bestehen. Ein LAN9354 (auch von SMSC und äquivalent
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Schaltplan eines Ethernet-PHY-Chips
Ethernet - PHY, C6 470pF C12 1uF, U4 LAN8742A-CZ-TR, PHY RXD0, PHY RXD1, PHY TXD0, PHY TXD1, PHY TXEN, PHY CRS DV, PHY MDC, PHY MDIO, R7 10k, R8 10k, R9 10k, R10 10k, R11, R12, R13 10k, R14 10k, R15 33, R16 1.5k 0.1%, R21 12.1k, X2 ASE-25.000MHZ-LC-T
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lwIP, STM32H7, DMA, Cache und DHCP mag nicht
bekomme ich beim Einschalten auch oft den Fehler das Ethernet nicht reagiert. In dem Fehlerfall meldet LAN8742_init() einen Fehler -2, Reset Timeout. Dieser wird aber in der Cube generierten SW nicht abgefragt: https://github.com/JojoS62/Test-H743ZI2-lwip/blob/79bd3eb6f7d82179384d7a70a9411745cac3ca20/LWIP
gesteuert werden. Hier https://github.com/JojoS62/Test-H743ZI2-lwip/blob/79bd3eb6f7d82179384d7a70a9411745cac3ca20/Drivers/BSP/Components/lan8742/lan8742.c#L101-L126 wird in einer for Schleife eine variable addr gegen die aus dem SMR verglichen und wenn es nicht passt wird addr inkrementiert.
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STM32 NUCLEO H743ZI - Ethernet / WebServer-Probleme
SRAM, 2048 KiB flash in at least 128 KiB pages. file H743ZI_LwIP_Test.hex md5 checksum: ffe8c2f14a5b707fca956874d2494734, stlink checksum: 0x00a937bc 2023-05-02T16:13:54 INFO common.c: Attempting to write 207652 (0x32b24) bytes to stm32 address: 134217728 (0x8000000) 2023-05-02T16:13:55 INFO common.c
ICache = enable, CPU DCache = enable 7. DANACH: LWIP = enable 8. LWIP_Plattform_Settings Driver_PHY = LAN8742 9. LWIP_General_Settings DHCP = disable; IP-Adresse/Netmask/Gateway eintragen 10. CORTEX_M7_Parameter_Settings: Cortex Memory Protection Unit Control Settings - MPU Control Mode -> Privileged
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CubeIDE1.9 Konfiguration LAN8742
1.7 zu Version 1.9. Vorher hatte ich nie ein (bzw. sehr lange) keine Probleme mit der Kombination LAN8742 - lwip auf dem F407 bzw. diversen F7xx. In der CubeIDE wird der Treiber beim F4 für die PHY LAN8742 seit dem Update separat unter Drivers/BSP aufgeführt. Ich vermute hier mein Problem. Wenn
pingen. Wenn ich nun ein Projekt mit dem F439 aufsetze muss ich unter lwip->Platform Settings die Phy LAN8742 auswählen. Die weitere Konfiguration übernehme ich wie vom F7. Das Board fährt normal hoch. Beim Initialisierungsprozess der LAN8742 scheint alles zu laufen (u.a. Reset Routine). Dennoch ist
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Layoutempfehlung RMII
Hallo! Gegeben ist ein STM32F767BI (TQFP208) und ein LAN8720A/LAN8742A PHY (sind pinkompatibel zueinander), die per RMII verbinden sind. Die RMII-SIgnale sind auf ca 58mm+-4mm length-matched. Kürzer geht nicht, weil das Pinout bei ST etwas blöd ist und die
Also ich habs beim PIC32MZ und LAN8740 so mit Serienterminierung gemacht. Läuft problemlos.
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Wechselrichter Hoymiles HM-xxxx 2,4 GhZ Nordic Protokoll?
:55:BD 9A:AA:A8:2A:AA:AA:AA:AA:A2:97:AA:6A:AB:A9:AE:EA:AE:DA:79:2B:AA [2022-03-11 04:14:56.172] 3 4 22:34:55:93:10 4C:01:2E:77 [2022-03-11 05:46:00.747] 6 0 24:01:05:45:0B [2022-03-11 06:17:57.783
code] 1649772015 00 00DC 1B 2 95 73109025 73109025 010001017F00C702F900005E44039E08FBA3F89D AF08 A2DC DAA8 AF08 E3D3 E787 AF08 A2DC AF08 1F4A AF08 7860 0978 A436 A2DC A9E2 AEB6 08FE AF08 A2DC AF08 A9E2 25BB A2DC A9E2 F891 hm400: Voltage: 38.30V, Ampere: 1.990A, Power: 76.10W Total Production
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Einstieg(scontroller) in Ethernet Kommunikation mit STM32
Uli A. schrieb im Beitrag #6634978: > Also dann sowas ? Schrub ich doch!
Beitrag #6635176: > Ich würde mich da an den Empfehlungen von ST orientieren, ST verwendet den LAN8720 (ist auch auf den Waveshare drauf), neuere Boards den moderneren LAN8742A. Für die Basisfunktionalität sind die Register gleich, aber die PHY haben auch eine Adresse die per Hardware gesetzt ist
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Ethernet Phy LAN8742A RX Error
MHz sein und keine 25 MHz, 50 MHz am Controller wird nicht gehen. Und nein, es reichen 25 MHz am LAN8742A. Siehe: Johannes S. schrieb im Beitrag #6353943: > der LAN8742 hat doch selber eine PLL und läuft mit 25 MHz Quarz/ext. > Clock. Wenn man allerdings vom Controller her 25 Mhz erzeugt
sicher gehen will verfolgt man "die reine Lehre", und die sagt: Quarzoszillator oder Quarz direkt am LAN8742A.
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Ethernet mit STM32F207ZGT, LAN8742a und HR911105A
Hallo Forum, ich bin gerade dabei, einen STM32F207ZGT mit dem Microchip Phy LAN8742A und einem HR911105A (RJ45 Stecker mit Magnetics) in Betrieb zu nehmen. Der LAN8742A ist mit den Config-Pins auf Auto-Negotation eingestellt. Im Grunde an dieser Steller der Nachbau des Nucleo-F207ZG
jo mei schrieb im Beitrag #6352180: > Nachdem der LAN8742A ja überall > auf den Nucleo Boards drauf ist sollte das ja problemlos > funktionieren. Genau das war der Grund, warum ich mich für den LAN8742A entschieden habe. Den Aufbau habe ich auch
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STM32 eval board mit MAC aber ohne Eth PHY für SPE
Im Anhang ein Bild von meinen Testaufbauten mit F407 Chinaboards, LAN8742 Phy und RMII. Nicht ideal und sicher nicht für Wind und Wetter, aber funktioniert, auch mit beim Übetragen mehrerer Megabytes oder Tests mit apache-jmeter. Nur die billigen Dupontkabel kann ich
Varianten zu finden: https://github.com/mcauser?tab=repositories&q=f407&type=&language= Die Standard LAN PHY boards genauso bei eBay oder Ali unter LAN8720. Von Waveshare gibt es eines in etwas besserer Qualität, die billigeren Clone funktionieren hier aber auch. Zu den Dupontkabeln gab es hier auch kürzlich
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Anschluss Ethernet Stecker auf PCB
Hallo, ich nutze den LAN8742A. Finde leider keine Angaben zum Anschluss des CMCs im Datenblatt ode sonstiger Dokumentation des Herstellers. Auch eine Internetrecherche brachte sehr widersprüchliche Ergebnisse und leider nur
Hier noch mehr Informationen: ww1.microchip.com/downloads/en/DeviceDoc/LAN8742A%20QFN%20Rev%20A%20Schematic%20Checklist.pdf
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STM32F746 Discovery Schlafmütze
Server zu erhalten. Da mbed rtos nicht in Frage kommt vermute ich das die Defaulteinstellungen des LAN8742A Chips nicht stimmen. Weiß einer welches Bit in welchem PHY Register zu setzen ist um diesen Effekt abzuschalten? m.f.G. Dieter Gräf
zurück? Dieter Graef schrieb im Beitrag #4545728: > vermute ich das die > Defaulteinstellungen des LAN8742A Chips nicht stimmen. Du meinst dass der irgendwann nur noch ICMP Pakete, aber keine IP Pakete mehr durchlässt? Klingt unwahrscheinlich, da der PHY sich den Payload der Frames gar nicht anschauen
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Ethernet PHY für RMII mit 25Mhz gesucht
Das STM32F7 Disco-Board macht das, die nutzen einen LAN8742a-cz den Schaltplan kannst du dir anschauen. Ob der 407 den Clock-Eingang für ETH_RMII hat, den die in dem Beispiel nutzen ka.
CAN-Fan schrieb im Beitrag #4487739: > die nutzen einen LAN8742a-cz Hmm, das ist ein 24 pol. QFN. Mal schauen, ob ich das mit der Hand löten kann.
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Welcher PHY für STM32F4x7
verstehe: in context von Ethernet, wo taucht da PHY-ID auf? und warum finde ich in Datasheet von LAN8742A kein PHY-ID?
Das ist sogar im Datenblatt des LAN8742A erstaunlich gut erklärt. Außerdem schreibst Du hier im falschen Thread.
