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Forum: FPGA, VHDL & Co. clock-Signal erstellen


Autor: Gast (Gast)
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Hallo,

ich benötige ein clock-Signal mit genau 1 us. Dieses Signal soll in 
Verilog erstellt werden.
Bisher habe ich immer nur das Clock-Signal durch Instanzierungen 
übernommen, in diesem Fall geht das leider nicht.

Wenn es fertig ist soll der Code auf ein Xlinx-Board übertragen werden. 
Das Signal soll möglichst genau sein.

Wie geht das?

Gast

Autor: Gast (Gast)
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Ich würde einfach über ein clock enable die 1us "generieren". Counter 
hochzählen lassen ( entsprechend der Frequenz deines Quartz ) und nach 1 
us für einen Takt die clock freigeben. Oder ist das in deinem Fall nicht 
möglich ?

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