kritische Signalfrequenzen beim Leiterplattenentwurf

Marlow Gast 02.02.2009 12:26 #1132178

Hallo zusammen,
ich wüsste gern ab welchen Signalfrequenzen man beim 
Leiterplattenentwurf besondere Massnahmen ergreifen sollte? Auf was muss 
man da so alles achten, wenn man z.B. Speicher an ein FPGA ran hängt bei 
500MHz?

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Michael X. (der-michl) (Firma: vyuxc) 02.02.2009 13:46 #1132325

Die 'rise time' und die 'fall time' sind das Problem, nicht die 
Frequenzen.
Faustregel: 1ns sind 15cm laufzeit. Ist die Länge der Leiterbahn etwa 
die hälfte der Laufzeit bei der rise/fall time, dann reicht der normale 
Wahnsinn. Bist du drüber, dann willkommen in der impedanzkontrollierten 
Welt.

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Christian R. (supachris) 04.02.2009 00:05 #1134368

Oh holla, 500MHz. Das sind 2ns Periodendauer. Da hast du Anstiegszeiten 
im ps-Bereich. Also etliche GHz auf deiner Leiterbahn. Da gehört schon 
viel Fachwissen und Erfahrung dazu, das ordentlich hinzubekommen.

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