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Forum: FPGA, VHDL & Co. Nur Probleme beim Umstieg von Quartus auf Xilinx ISE


Autor: Rooney Bob (rooney)
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Hallo!

Ich versuch gerade ein VHDL Design, welches in Quartus II entworfen 
wurde, in die Xilinx ISE zu portieren.

Beauerlicherweise sind nun einige Zuweisungen nicht mehr 
synthetisierbar.

Ist die folgende Zuweisung nicht VHDL konform?

result := (("000" & maxPixel) - ("00" & (maxPixel - currentPixel) & 
'0'));

Xilinx regt sich offenbar wegen "000" & maxPixel auf und gibt folgenden 
Fehler aus --> "parse error, unexpected EQ"

Autor: Läubi .. (laeubi) Benutzerseite
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Rooney Bob schrieb:
> Xilinx regt sich offenbar wegen "000" & maxPixel auf und gibt folgenden
> Fehler aus --> "parse error, unexpected EQ"

Nö.. EQ entspricht '=' wie hast due den result definiert?

Autor: Fpga Kuechle (fpgakuechle) Benutzerseite
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Unexpecte EQ könnte darauf hinweisen das "Result:" am Beginn des 
Codeschnipsels  als Label interpretiert wird. Steht die Beispielzeile 
nicht im richtigen Kontext?! (innerhalb Process, procedure und so). Oder 
ist result nirgends deklariert? Gibt modelsim an dieser Stelle eine 
Warnung aus?

MfG

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