[Eagle DRC] Grund für "Clearance" Fehlermeldung

Gast #1432672 
Hallo,

habe nun meine Platine im Eagle fertig und den DRC durchgelaufen.
Habe 640 Fehler, wobei die meisten "Clearance Errors" bei den Via's sind 
und ich das nicht ganz verstehe:
Ich habe bei allen Bausteinen, die eine Ground-Fläche zur Kühlung auf 
der Rückseite haben, auf dem gegenüberliegenden Außenlayer eine 
entsprechend gleiche Fläche mit dem Polygon-Befehl gezeichnet und dann 
mit zahlreichen Via's durchkontaktiert. Nur zeigt der DRC mir bei allen 
diesen Durchkontaktierungen einen "Clearance" Fehler an, obwohl beide 
Flächen sowie alle Via's zum gleichen Signal gehören und Eagle sie auch 
richtig verbindet und nicht ausspart nach dem "Ratsnest" Befehl.

- Kann das daran liegen, dass diese Massefläche zur Kühlung in der 
Library als "Pad" gezeichnet würde und man keinen Durchkontaktierungen 
im Pad setzen kann?

- Kann man auftretende Fehler, die man quasi akzeptiert, ausblenden? 
Ansonsten ist's relativ unübersichtlich mit der Fehlerauswertung beim 
DRC.

LG Mille
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@  Mille (Gast)

>- Kann das daran liegen, dass diese Massefläche zur Kühlung in der
>Library als "Pad" gezeichnet würde und man keinen Durchkontaktierungen
>im Pad setzen kann?

Ja.

>- Kann man auftretende Fehler, die man quasi akzeptiert, ausblenden?

AFAIK nein.

MFG
Falk
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Gast 
Danke für die Antworten...

Ich verwende auch 4.16... ohne das man die Fehler individuell ausblenden 
kann ist's schon relativ unübersichtlich Schritt für Schritt die Fehler 
im DRC durchzugehen.

Wie macht man das in der 5.6 Version? Gibts da in dem Fehlerfenster nach 
dem DRC ne Option zum Ausblenden? Werde mal in 4.16 nach sowas suchen...

- ist dem Leiterplattenhersteller eigentlich die Fehler im DRC egal bzw. 
sieht der da irgendwas?

lg mille
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Hi,



> Wie macht man das in der 5.6 Version? Gibts da in dem Fehlerfenster nach
> dem DRC ne Option zum Ausblenden? Werde mal in 4.16 nach sowas suchen...

Da kannst du Fehler billigen. Probier mal die Freeware, dann siehst du 
es.



> - ist dem Leiterplattenhersteller eigentlich die Fehler im DRC egal bzw.
> sieht der da irgendwas?
Das hängt davon ab. Ein Hersteller interessiert sich nicht für den DRC 
vom Adler, er hat nur Interesse daran, daß sein Fertigungsprozeß keine 
Zicken macht. Er wird die Gerber Daten auf Einhaltung der 
Fertigungstoleranzen seiner Fertigung prüfen.

Soll heißen:
Im Normalfall wird er das fertigen, was du ihm vorgibst. Es ist nicht 
sein Job, deine Gedanken zu lesen. Machst du grobe Schnitzer, wird er 
dich warnen, weil er die Platine nicht fertigen kann. Aber ob das 
Endprodukt auch wirklich dem entspricht, was du erwartest, steht auf 
einem ganz anderen Blatt.

Ulrich
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Gast 
Verwende noch den 4.09-Adler, aber ich vermute daß die
Fehlermeldung egen der Vias im SMD-Pads erscheint. Ist
schon verständlich, denn im Pad kann ein Via bedeuten daß
das Zinn "durchs Via abhaut", was auch nicht so toll ist.
Frag doch einfach mal beim LP-Hersteller wie er mit den
Fehlermeldungen vom Adler umgeht und vermerke welche er
ignorieren muß.

Gruß

James
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Persönliche Seite 
Falk Brunner schrieb:

>>- Kann man auftretende Fehler, die man quasi akzeptiert, ausblenden?
>
> AFAIK nein.

Ja, in 5.6, teilweise. Aber es gibt Fehler, die kann man zwar abnicken, 
die werden aber bei jedem Oeffnen des Layouts dann wieder reaktiviert, 
so dass es dort nichts bringt. Etwas konfus und ohne eine erkennbare 
Logik.
Antwort Zitieren Bearbeiten Löschen Melden Danke 
Der LP-Hersteller wird sich vermutlich kaum um solche Fehler kümmern, 
wenn es nicht gerade fertigungstechnische Gründe gibt. Der wird also 
kaum einen DRC machen.
Jedenfalls wurde meine letzte Platine anstandslos trotz seitenweiser 
Clearance-Fehler gemacht - der Hersteller muß ja nicht wissen, ob das 
nun ein Pad oder eine normale Massefläche ist. Das ist für die Fertigung 
vollkommen wurscht.
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