400MHz auf 200MHz Device speichern

Thorben Gast #1637158
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Hallo, ich muss einen Datenbus mit 32Bit Breite und 400MHz 
Abtastfrequenz speichern. In meiner Schaltung wurde nur ein 100MHz SRAM 
und 50MHz Quarzossizaltor eingeplant und nun hänge ich an der Umsetzung 
fest.

Mein Lösungsvorschlag:

Die 50MHz Taktfrequenz wird mit einer DCM Stufe um den Faktor 4 erhöht. 
Die Samplestufe mit Multiplexer 32 to 64 Bit Multiplexer arbeitet dann 
mit 200 MHz und die ersten 32 Bit sind die älteren Daten. Das Verfahren 
wurde vom Sump LA abgeschaut. Wie bekomme ich nun meine Daten 64Bit 
breit in ein 32Bit breites SRAM ohne Waitstates? Muss in das HW Design 
ein zweites SRAM mit 32Bit eingeplant werden ?
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Klaus F. #1637201
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Thorben schrieb:
> Wie bekomme ich nun meine Daten 64Bit
> breit in ein 32Bit breites SRAM ohne Waitstates? Muss in das HW Design
> ein zweites SRAM mit 32Bit eingeplant werden ?

Zuallererst musst Du das SRAM wählen. Aus dem Datenblatt ersiehst Du, 
wie schnell Du die Daten schreiben kannst. Daraus ergibt sich die Anzahl 
der SRAMs, die Du parallel betreiben musst.

400 MHz x 4 Byte sind 1.6 GByte/s. Das ist schon anspruchsvoll.
Falls das nur ein Hobby-Projekt ist, würde ich Dir empfehlen, eine 
fertige FPGA Platine zu verwenden.
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Iulius Gast #1638298
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Man muss nicht unnötig viel Hardware einplanen.

Was für ein Signal soll das denn sein das sich 400 Millionen Mal pro 
Sekunde ändert ?

Warscheinlicher ist doch, das du nur so oft abtastest, aber gar nicht so 
viele verschiedene Samples hast/brauchst. In dem Fall kannst du ja 
welche verwerfen und der 100mhz 32Bit SRAM reicht doch.


Letztendlich würde es mich auch wundern wenn der nicht reicht.
Selbst ein 32Mbyte großer SRAM (gibts die größer ? wenn dann wohl kaum 
wirtschaftlich) wäre da nach 20 ms voll.

Das bekommst du mit hoher warscheinlichkeit eh nicht weggeschrieben, 
wohin auch immer, also warum im SRAM puffern ?


Was soll das denn werden ?
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