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Forum: FPGA, VHDL & Co. Altera Quartus: Zugriff auf Zeitpunkt des Builds


Autor: Matthias (Gast)
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Hallo,

wir versuchen gerade, unsere VHDL projekte im FPGA irgendwie 
identifizierbar zu machen, und die einfachste Idee, um verschiedene 
Versionen zu unterscheiden scheint uns, den Zeitpunkt des Builds 
irgendwie im FPGA abzulegen.
Nun such ich krampfhaft nach einer Moeglichkeit, wie ich Quartus 
beibiegen kann die Uhrzeit automatisch auszulesen und irgendwie in den 
Fit einzubinden. Hat das schon mal jemand hinbekommen?

vielen Dank schonmal fuer Antworten/Hilfe.

MfG,
Matthias

Autor: Duke Scarring (Gast)
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Kannst Du Quartus ein pre-build Script mitgeben? Dort könntest Du per 
TCL, Python, Perl, Bash oder whatever den Datumsstring o.ä. im Quelltext 
ändern.

Duke

Autor: Matthias (Gast)
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Bereits geloest. Bisschen gefrickel mittels TCL script, aber geht sehr 
gut.

Autor: Ben (Gast)
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Hi Matthias,
könntest du deine Lösung mal posten ?

Autor: Matthias (Gast)
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Die fertige loesung nicht, da Firmen-Datei. Aber ich kann eben den 
Altera Link durchgeben:

http://www.altera.com/support/examples/tcl/tcl-ver...

Ich hab nun das Datum und die SVN nummer drin. Funktioniert toll.

Autor: Ben (Gast)
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Hey das ist super ! Vielen Dank & Gruss,
Ben

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