Eagle Flächen, Bahnen und Leiterplattenhersteller

Eagleuser Gast #2395146
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Hi,

wie ist das eigentlich, wenn ich kleinere Fragmente wie das im Bild hab.

Das Rote ist alles VCC und liegt auf dem selben Layer, fertigt der 
Leiterplattenhersteller, wie zum Beispiel Conrad dann diese kleine Bahn 
extra oder macht er alles in die dicke fläche rein?

Wie kann man denn erreichen, dass 2 Pins von so nem SO8 Gehäuse, die auf 
VCC liegen zu einer Lötfläche zusammen geführt werden?

Lg Eagleanfänger
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G. C. #2395180
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> wie ist das eigentlich, wenn ich kleinere Fragmente wie das im Bild hab.

Mein Eindruck hier: Solche Fragmente entstehen typischerweise, wenn man 
ein bereits geroutetes Bauteil ein wenig verschiebt. Da hift ein ripup 
auf das Stückchen und ein anschließendes ratsnest.
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Klaus K. #2396072
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Die Platinenhersteller haben mit solchen 'Kleinigkeiten' keine Probleme.
Es wird ja im Fertigungsprozess eine komplette Maske 'gedruckt' (oder 
belichtet, oder ...), da ist es fast egal wie groß die einzelnen Stücke 
sind.
Es ist eigentlich nur unschön.

Gruß Klaus
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Alter Adler Gast #2399680
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Solche Fragmente jucken keinen, die gehen sozusagen in der Leiter-
bahn unter, das sieht man nicht mehr, dürften sogar im Gerberfile
verschwinden. Schätze daß die modernen Photoplotter das alles
rausrechen und nicht noch mal zeichen.

Und Maik hat recht direkt zu PCB-Pool gehen, ist einfacher und
schneller. (Wenn mal was unklar ist, die fragen zurück bevor was
passiert, bin sehr zufrieden mit dem PCB-Service!)
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Maik G. #2399879
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Alter Adler schrieb:
> Solche Fragmente jucken keinen, die gehen sozusagen in der Leiter-
> bahn unter, das sieht man nicht mehr, dürften sogar im Gerberfile
> verschwinden. Schätze daß die modernen Photoplotter das alles
> rausrechen und nicht noch mal zeichen.
Sry. ich hab dies leider auch schon durch... die werden nicht 
verschwinden. Stehen sogar mit drinne. Hatte deshalb schon 2 Rückrufe 
von PCB.

deshalb guter Tip, wenn sowas auftaucht versuchen zu beseitigen... Spart 
massen Streß
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Eagleuser Gast #2400266
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Meine Platine ist ja 2 lagig, ich hab außerdem die Dummheit gemacht, 
Leiterbahnen zu vergrößern, indem ich einfach selber welche nochmal 
gezogen hab und mit dem Namebefehl diese mit den dazugehörigen verbunden 
habe.
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