Forum: FPGA, VHDL & Co. Avalon MM Master Templates


von hans (Gast)


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Hat jemand schon mal mit den templates von der altera seite gearbeitet?

http://www.altera.com/support/examples/nios2/exm-avalon-mm.html


Ich habe probleme mit dem beschreiben lesen aus den Master fifos. 
Manchmal werden die selben 4Bytes(32Bit Data Width) mehrmals in den Fifo 
gelesen manchmal nicht. Ich schreibe z.B alle 2 Clockcycles etwas in den 
WriteFifo  ist das zu schnell? Das schreib Signal halt ich einen 
Clockcycle auf High ist das zu wenig?

Vielleicht hat das ja schonmal jemand benutzt und kann mir dazu hinweise 
beziehungsweise Code geben zum ansteuern der Fifos.


Danke

von hans (Gast)


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ich benutze um das schreiben anzustoßen einen entprellten taster dann 
werden 3x4 bytes in den Fifo geschrieben und dann über den avalon bus in 
den dddr 3 geschrieben. kann der vielleicht ein fehler auftreten? ich 
habe den taster auf 40ms entprellt

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