Frage zu Verilog "+:"

Gast #2803590
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Moin,

das bedeutet, du nimmst ab Bit 17 die nächst höheren 17 Bit aus einem 
Vektor. Mit - würdest du ab Bit 17 die nächst niedrigen 17 Bit 
auswählen. Also:
1
[17+:17] = [33:17]
2
[17-:17] = [17:1]
Macht aber eigentlich nur Sinn, wenn du einen variablen Index links 
stehen hast. Z.B. [i+:1], da Verilog sowas wie [i+1:i] nicht 
unterstützt.

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