Forum: FPGA, VHDL & Co. Wert der Pull-Up Widerstände


Wert der Pull-Up Widerstände
von Hans (Gast)

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Hallo,
benutze für mein Abschlußarbeit einen Spartan 6 FPGA als Gegenstück für 
einen Boundary Scan Test. Als Configurations Mode habe ich Master Serial 
gewählt.

In welchen Zustand gehen die I/Os des FPGA nach dem BST(Pull-Down, 
Tri-State,...)?

Wo und in welchem Datenblatt kann ich Infos über die Größe der Pull-Down 
bzw. der Pull-Up Widerstande finden?


Danke im voraus
Hans

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Re: Wert der Pull-Up Widerstände
von Christian R. (supachris)

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Pull-Down oder Tristate während der Config-Phase ist abhängig vom Pegel 
am HSWAP Pin. Das steht im Configuration User Guide.
Der Wert der Pull-Widerstände müsste im DC and Switching Data Sheet 
stehen.

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