Quartus: Signale in VHDL-Code verfolgen

OP #3226224
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Hallo

Ich bin noch relaitv neu in der VHDL Programierung und muß jetzt aber 
doch recht umfangreiche FPGAs übernehmen und weiter pflegen. Ich suche 
jetzt nach einer Möglichkeit in Quartus Signale zu verfolgen.
Z.B. habe ich ein Ausgangssignal (out in Portmap) und möchte gerne 
wissen, durch welche Module das durch geht und welche Eingangssignale 
darauf Einfluß haben. Bisher fiesel ich mich da Datei für Datei über 
Portmap und Signalnamen durch. Wenn es da eine einfachere Möglichkeit 
gäbe wäre ich für Tips sehr dankbar.

Danke und Gruß Ulf

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