Forum: FPGA, VHDL & Co. Schrift auf Display ausgeben mit Altera DE2 -115


von E. H. (epimeth)


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Hallo,
ich habe vor Schrift auf einem Display auszugeben.
Nun habe ich jedoch folgendes Problem, das Ausgeben selbst funktioniert 
jedoch nicht in der Reihenfolge wie es sollte.
Bei jeder neuen Zeile auf dem Display wird der Counter um 1 erhöht, und 
gibt richtig aus.
Eine Änderung der Spalte führt aber zu keinem hochzählen des Counters,
weswegen, es am Ende auf dem Display folgendermaßen aussieht.

REAL             Gewünscht
AAAAAAA          ABCDEF
BBBBBBB          fortlaufend
CCCCCCC
(kein Flackern oder verlaufen der Schriftsätze)

Könnte sich bitte jemand die Komponente ansehen und sagen, woran es 
liegen könnte oder wo ich vll im Netz dazu noch etwas finde? Danke für 
die Mühen.

Die Betreffende Komponeten heißt ROM.vhd.

Im Anhang habe ich mal die gesamte Datei hochgeladen.

von Karl (Gast)


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Was sagt die Simulation? Das sollte doch schnell simuliert sein und dann 
wird der Fehler auch schnell gefunden.

Zudem schau dir nochmal in deinem VHDL Buch den Abschnitt zu 
synchronen/getakteten Prozessen und der Sensitivitylist an.

von Lothar M. (Firma: Titel) (lkmiller) (Moderator) Benutzerseite


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Und sieh dir mal an, was die Funktion rising_edge() macht. Dann wird 
diese Zeile kürzer:
IF( (Clock = '1')  and (rising_edge(Clock))) then

Und auch ich würde hier sehr empfehlen, eine Simulation zu starten. 
Immerhin ist der Simulator der Debugger von VHDL...

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