Modelsim Fehler bei Simulation von Altera Transceivern

Gast #3807988 
Hallo Zusammen!

Da ich im Altera-Forum leider bisher keine Lösung für mein Problem 
gefunden habe, versuche ich es noch mal hier. Ich bin gerade dabei die 
Übertragungsstrecke zwischen zwei Altera Cyclone IV Transceivern im 
Basic-Mode mit Modelsim PE10.2c zu simulieren. Ich meine alle 
notwendigen Librarys mit dem aus Quartus erzeugten TCL File kompiliert 
zu haben. Prinzipiell läuft die Sache auch (in der Testbench Tx auf Rx 
gelegt) - jedoch nur, wenn ich dem Transceiver 1us lang ein 
gxb_powerdown gebe und alle Reset Signale auf 0 lasse, nicht jedoch, 
wenn die im Datenblatt angegebene Reset-Sequenz angelegt wird. Dann wird 
zwar das K25.5 Sync Symbol gesendet, aber der Empfänger lockt sich nicht 
darauf ein.
Ein Grund dafür könnte sein, dass ich beim Start der Simulation einen 
ganzen Haufen Warnmeldungen vom gleichen Typ bekomme:  "*** Warning: 
(vsim-8684) No drivers exist on out port /…/…, and its initial value is 
not used. Therefore, simulation behavior may occur the is not in 
compliance with the VHDL standard as the initial values come from the 
base signal /…/…".

Hat jemand von Euch einen Tipp, wie ich die beheben kann?

Danke und viele Grüße

Achim
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Gast 
> Das sieht doch so aus, als würde eine Simulationsbibliothek nicht
> richtig eingebunden...

Absolut! Nur weiß ich nicht, was nicht eingebunden ist. Quartus erzeugt 
mit "Tools/Run Simulation Tool/ RTL Simulation" ein TCL File, das die 
Kompilierung und mapping aller notwendigen Bibliotheken übernimmt. Für 
die Transceiver sind das vor allem die altera_mf und cycloneiv_hssi. Die 
sind beide drin - prinzipiell sind die Transceiver als Primitive auch 
richtig eingebunden. Ich habe keine Idee mehr, was noch fehlt.
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