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Forum: FPGA, VHDL & Co. Virtex CLKDLL / Testbenchfehlermeldungen


Autor: Tom (Gast)
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Hallo zusammen,

ich habe mir nach dem Xilinx AppNote 132 einen Clockhalbierer
zusammengebaut, der aber in der Simulation nicht funktioniert.
Die Testbench werde ich in einem zweiten Post hinterlegen.
Die Fehlermeldung lautet:
WARNING:Simulator : 93 - Request to trace Signal ...usw

Ich habe leider keine Erklärung dafür, vielleicht aber Jemand aus dem
Forum.....

Vielen Dank für etwaigen Support...!!!

Gruß
Thomas

Autor: Tom (Gast)
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Hier die Testbench mit angehängter Fehlermeldungen

Autor: Tom (Gast)
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Hallo nochmal,

hat keiner eine Idee für mein Problem?!?

Verzweifelte Grüße
Tom

Autor: Xenu (Gast)
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Wieso liest Du Dir nicht einfach mal die Fehlermeldung durch?

"Tracing of array of physical type is not supported."
"Tracing of record type is not supported."

Steht doch da was los ist.

Autor: Tom (Gast)
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Hallo Xenu,

hmm, was ist denn da los?!? Irgendwie werden Arrays von physikalischen
Typen (Zeit) generiert, die nicht überwacht werden können....

Kann ich also den Code nicht simulieren?!?

Gruß
Tom

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