Forum: FPGA, VHDL & Co. ISE Pre Execute TCL Script


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von Peter (Gast)


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Hallo,

gibt es eine Möglichkeit vor der Synthese automatisch ein TCL Script 
auszuführen? Wenn ja wie?
Ich möchte mir darüber ein vhdl File generieren um den aktuellen 
Timestamp der Synthese in einen Vektor schreiben zu können.

Peter

von RB (Gast)


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Bei kurzem googln hab ich das hier gefunden:

http://www.nuvation.com/blog/fpga-design-services/fpga-design-tip-automatically-identify-build-timedate-2

Sollte genau das sein, was du machen möchtest.

von Peter (Gast)


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Ja genau das jedoch nicht mit Vivado, sondern mit ISE.

Die Option von Vivado hatte ich auch schon gefunden und auch ein 
passendes Script.

Peter

von Cle (Gast)


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Peter schrieb:
> Ja genau das jedoch nicht mit Vivado, sondern mit ISE.
>
> Die Option von Vivado hatte ich auch schon gefunden und auch ein
> passendes Script.
>
> Peter

Mit ISE steht doch weiter unten auf der Seite?
Erst kommt das Vivado Beispiel und dann das ISE Beispiel.

von Peter (Gast)


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Ja nur scheint das auch nicht mit XST zu funktionieren (Command not 
found)

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