Clocksignal 180 Grad CPLD

Dirk Gast #389071
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Hallo,

bis jetzt hab ich eigentlich immer nur alles in einem FPGA realisiert,
weil diese DCM's / DLL Stufen besitzen. Die DCM Stufe bietet die
Moeglichkeit das Clocksignal um 180 Grad auszugeben.

Kann ich bei einem CPLD dafuer auf CLOCK "0" reagieren oder muss ich
auf etwas achten?

Gruß,
Dirk
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