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Forum: FPGA, VHDL & Co. Aus Matlab/Simulink VHDL-Code generieren


Autor: Silvio Krause (tomy_20)
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Hallo Leute,
ich möchte gern aus Matlab/Simulink VHDL-Code generieren. Für diese
Aufgabe suche ich noch geeignete Tools, bis jetzt habe ich den DSP
Builder und den System Generator gefunden. Gibt es noch weitere Tools
die dafür geeignet sind? Hat jemand schon mit den oben genannten Tools
gearbeitet?

Gruß Silvio

Autor: panzer (Gast)
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Hi,

neulich kam per Newsletter sowas:
http://www.model.com/company/news_events/news_rele...

Ich habe keinerlei Erfahrung dmait.

Gruss,
panzer

Autor: Silvio Krause (tomy_20)
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Hi panzer,
Danke für den Hinweis. In dem Beitrag geht es um ModelSim, dass aber
nur  zur Simulation dient.
Gruß Silvio

Autor: Thomas B. (paraglider)
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Hallo Silvio,

ich wage sehr zu bezweifeln, dass da was sinnvolles rauskommen kann.
Das ist etwa so wie der Versuch, aus einem Foto eine Vektorgraphik
machen zu wollen. Es geht - aber die Vektorgraphik ist riesig groß und
hat nichts von dem, was man von einer Vektorgraphik erwarten würde.

Gruß,
Thomas

Autor: Stephan (Gast)
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Da kannst du ja zweifeln so viel du willst, Fakt ist: es gibt bereits
vertige Lösungen auf dem Markt (von Altera, Xilinx und The Mathworks
selber) und ne menge Leute arbeiten schon erfolgreich damit. Für
LabVIEW gibt es sowas übrigens auch.

Autor: Silvio Krause (tomy_20)
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Hallo Stephan,

Du scheinst dich damit auszukennen. Kannst du mir Infos oder
Infoquellen  zu diesem Thema zur Verfügung stellen? Danke
Gruß Silvio

Autor: T.M. (Gast)
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Autor: Der Simulinker (Gast)
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T.M. bittte melde ich mal, wenn Du noch mitliest.

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