Forum: FPGA, VHDL & Co. vhdl-extras FIFO


vhdl-extras FIFO
von Jens E. (Gast)

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Kennt sich jemand mit den FIFOs in der vhdl-extras library aus? Ich 
würde gerne wissen wie viele Takte das lesen dauert, wenn ich das 
SYNC_READ Generic auf false setze. Nach meinem Verständnis müsste das 
lesen doch bei true 2 zyklen dauert und bei false nur einen, oder 
übersehe ich hier etwas?

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Re: vhdl-extras FIFO
von FPGA Notfallseelsorge (Gast)

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Ne, kenne ich nicht, hat man aber in wenigen Minuten durchsimuliert.

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