Hi,
Ich blicke gerade nicht durch, wo der Fehler beim Impedance Matching im folgenden liegt:
Habe den Layer Stack von JLCPCB (JLC04161H-3313) genommen und diesen in Altium übernommen. Wenn ich nun S50 und D100 berechnen lasse, dann bekomme ich trotz gleichen Parametern wesentlich unterschiedliche Trace Width.
S50:
- Altium: 0.17065mm
- JLCPCB: 0.1565mm
D100:
- Altium 0.14mm bei 0.2032mm gap
- JLCPCB 0.1217mm bei 0.2032mm gap
Jemand eine Idee, wo der Fehler liegt?
JLCPCB Calculator: https://jlcpcb.com/pcb-impedance-calculator




