D-Fliplop in LTSpice

Gast #595754 
Hallo!

Ich möchte in meiner Schaltung ein D-FlipFlop einsetzen um zwei 
unterschiedliche Frequenzen miteinander zu "vergleichen". Als erstes 
möchte ich das aber in LT Spice simulieren (siehe Anhang!). Mein Problem 
ist nun dass mir nicht ganz klar ist wie ich dem FlipFlop (aus der 
mitgelieferten Bauteilbibliothek) die Schaltschwellen mitteile...

kann mir jemand einen Tip geben?

Danke schonmal!!!

Gruss Franz
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Gast 
rtfm...

D Flip-Flop
Input: D, CLK, PRE, CLR, Output: Q, _Q
Same parameters as OR gate.  Data is edge-triggered. Hold
time not required.
Unconnected pins are disabled during simulation. Pins can
not be connected to dangling wires.

Parameters:
Trise: Rise time. Defaults to 0.
Tfall: Fall Time, Defaults to Trise if not specified.
Td: Gate delay time.
Vlow: Low output level. Defaults to 0V.
Vhigh: High output level.  Defaults to 1V.
Vt: Logic threshold.  Defaults to the average of Vhigh and
Vlow.

und wohin damit? siehe bild...
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