Xilinx CPLD XC9572XL

Gi-Gi Gast #297497
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Hallo, vielleicht könnt ihr mir helfen,
ich habe eine Platine auf der man einen CPLD XC9572XL (und div. andere
CPLD's) programmieren kann zusammengebaut. Programmiert wird das ganze
mit dem ISE WebPack von Xilinx (ver.7.1i)

Jetzt mein Problem:
wenn ich einen Schaltplan im Schematic eingebe, die UCF-Datei erstelle
usw. usw. funktioniert zwar das programm aber die pins geben immer High
aus obwohl laut Programm LOW anliegen sollte! Dies ist jedoch nicht bei
"OR-Verknüpfungen" so, hat jemand eine Idee an was das liegen könnte?
hab ich vergessen etwas einzustellen?
PS: es hilft auch nicht die Ausgänge über Inverter anzusteuern, der
Ausgang bringt trotzdem High. Die Verknüpfung an sich funktioniert.
d.h. wenn ich "Pin35 and Pin36 = Pin24" als Schaltfunktion eingebe
leuchtet die Diode an Pin24 und wenn 35+36 gesetzt werden geht p24
aus!?

Danke schon mal fürs lesen, und wenn jemand was weiß...

Gruß Georg
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Tobias O. Gast #297498
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Nicht benutzte Pins werden automatisch entweder mit "pull up" oder
"pull
down" Widerständen belegt je nachdem was du einstellst. Scheint so das
du die Pins nicht benutzt, und dann kommt sowas dabei rauskommt.

Gewöhn dir mal an deine Programme mit VHDL oder Verilog zu schreiben,
mit der Eingabe durch Schematic schleichen sich leicht Fehler ein.
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Gi-Gi Gast #297499
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Danke für den Tipp mit VHDL bzw. Verilog, das Problem ist, manche
Aufgaben sind für die Fachhochschule als Übung gedacht, und dort wird
das meiste (zumindest jetzt) über das Schematic gemacht... :(

Übrigens des Rätzels Lösung ist die etwas ältere Version des ISE
WebPack (hab jetzt die 6.3 und mit der funktioniert es tadellos!

Trotzdem DANKE, und für private Zwecke werd ich mich dann mal tiefer in
VHDL einarbeiten..
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Xenu Gast #297501
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>Übrigens des Rätzels Lösung ist die etwas ältere Version des ISE
>WebPack (hab jetzt die 6.3 und mit der funktioniert es tadellos!


Bei der 7.1er-Version musst Du Dir die Service-Packs installieren.
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