[VHDL] unsigned to bit_vector

OP #1881932
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Hi

Ich suche eine möglichkeit von unsigned nach bit_vector zu wandeln.

Mein Ansatz war:
1
library IEEE;
2
use IEEE.numeric_bit.ALL;
3
use IEEE.numeric_std.all;
4
-- [...]
5
   signal Qout1, Qout2: unsigned(3 downto 0);
6
-- [...]
7
   Qout1_bit <= bit_vector(to_bit(Qout1));

Aber das gibt eine Fehlermeldung
[quote]
Error 10621: VHDL Use Clause error at bcd_counter.vhd(10): more than one 
Use Clause imports a declaration of simple name "unsigned" -- none of 
the declarations are dircetly visible
Error 10784: HDL error at numeric_std.vhd(65): see declaration for 
object "unsigned"
Error 10609: VHDL error at numeric_bit.vhd(62): another match for 
"unsigned"
[/quote]

Ich find nichts wie ich den Typ trotzdem umwandeln soll ... ich nutze 
unsigned um den Zahlenwert in einem Counter zu inkrementieren.


Grüße
Moderator (Firma: Titel) Persönliche Seite #1881939
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Ano Nym schrieb:
> Aber das gibt eine Fehlermeldung
Die besagt, dass ein Typ namens unsigned mehrfach definiert wurde.
In numeric_bit:
1
type UNSIGNED is array (NATURAL range <> ) of BIT;
Und in numeric_std:
1
type UNSIGNED is array ( NATURAL range <> ) of STD_LOGIC;
Du wirst dich entscheiden müssen, ob du nun Bitvektoren oder 
STD_LOGIC-Vektoren verwenden willst. Ich würde dir den üblichen 2. Weg 
vorschlagen...
Gast #1882069
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@Ano Nym:

Falls Du doch beide Bibliotheken brauchst, kannst Du auch explizit 
mitteilen, welche Du verwenden möchtest:
1
library IEEE;
2
use IEEE.numeric_bit.ALL;
3
use IEEE.numeric_std.all;
4
-- [...]
5
   signal Qout1, Qout2: ieee.numeric_std.unsigned(3 downto 0);
6
-- [...]
7
   Qout1_bit <= bit_vector(to_bit(Qout1));

Duke
OP #1882497
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Hey

Danke. Ich sollte wohl dazu sagen das ich erst mit VHDL angefangen habe.

Hab jetzt alles auf std_logic_vectoren anstelle von unsigned und 
bit_vector umgebastelt und ich konnte compilen (kompilieren). Was mein 
Board davon hält werde ich morgen rausfinden - bin gerade erst 
aufgestanden und bin gleich weg :)


Grüßle

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