Xilinx Webpack ISE - RTL Simulation

OP #2058358
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Hallo zusammen,

bin hier der absolute Neuling und hab daher jetzt erstmal ne generelle 
Frage.
Ich benutze Xilinx ISE 12.4 und bin gerade dabei das "Flash" Beispiel 
projekt durchzuarbeiten. Ich komme jedoch im Moment nicht weiter.
Die Testbench ist ja in diesem Beispielprojekt schon erzeugt, und jetzt 
wollte ich eine einfache RTL simulation machen. ( also auf Gatterebene 
ohne SchnickSchnack). Leider finde ich irgendwie nirgens, mit welchem 
tools man sich wirklich den zeitlichen Verlauf der einzelenen Signale 
anschauen kann. Ich kenne aus frühesten Semestern den Model Sim - 
Simulator... Brauch ich den dazu?, oder welches tool muss ich benutzen, 
um so eine SImulation mit ISE zu machen?

Gruss Daniel und danke für eure Antworten!

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