Sperrwandler mit PSPICE

Timo Gast #2071485
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Hallo

ich bin neu im Umgang mit PSPICE.

ich bin gerade dabei einen art Sperrewandler aufzubauen. Meinen Takt 
generiere ich in einem CPLD. Ich dachte so an eine Taktfrequenz von ca 
100Mhz.

Die Schaltung hat auf der Primärseite 24V.
Auf der Sekundärseite soll 12V Gleichspannung rauskommen.
Als Last sollen <20 mA fließen.

Ich habe später mehrere Platinen auf denen ich galvanisch getrennte 
voneinander 12V benötige.
Auf der ersten Steuerplatine habe ich den CPLD und die 24V.
Auf den weiteren Platinen, drei an der zahl, sitzen dann jeweils der 
Transformator, Gleichrichter und Last.
Die Übetragung erfolgt über Flachbandkabel, daher wollte ich ein 
symmetrischen Signal erzeugen. Dies wollte ich mit C2 erreichen 
(Gleichspannunganteil sperren).
L1 und L2 habe ich als Leitungsinduktivität für das Flachbandkabel 
eingebaut.

Nur leider kommt bei der simulation überhaupt nicht raus was ich 
erwarte.

Ich hoffe mir kann jemand helfen

Danke schon im vorraus an alle

grüße
Timo
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I. L. Gast #2071531
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Fritz schrieb:
> Und dann guck dir mal N- und P- Kanal-FETs an und wie man sie
> veraschaltet - so verschaltet man einen N-Kanäler nicht.

Lass dich nicht beirren, so wie du es gemacht hast is es richtig!

Aber deine ganze Schaltung scheint etwas fraglich, guck ma:
Der Kondensator C2 muss Parallel zum Trafo + Schalter, nicht in Reihe!

Aber du solltest mehr Gatespannung "geben" so 12-15V etwa

Gruß Knut
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Timo Gast #2071687
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I. L. schrieb:
> Aber deine ganze Schaltung scheint etwas fraglich, guck ma:
> Der Kondensator C2 muss Parallel zum Trafo + Schalter, nicht in Reihe!
>
> Aber du solltest mehr Gatespannung "geben" so 12-15V etwa
>
> Gruß Knut

Hallo Knut

Danke für deine Antwort.

ich wil ja mit dem FET erreichen, dass ich eine PWM habe von 0V bis 25V 
und mit C2 will ich nun eien symmetrische Spannung von -12V bis +12V 
haben. Da muss ich C2 doch in Reihe schalten und nicht parallel oder bin 
ich nun komplett falsch??

gruß
Timo
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