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Forum: FPGA, VHDL & Co. Quartus II EDIF File


Autor: Jim G. (jim34)
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Hallo,

ich brauche aus einem Quartus II ein EDIF File, um die Ports zu 
exportieren. Ist das möglich, oder brauche ich da ein extra Programm 
für?

Autor: Harald Flügel (hfl)
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Hallo Jim,

wie Du aus der starken Resonanz auf deinen Post entnehmen kannst, ist 
den Forumsteilnehmern die Aufgabenstellung wohl nicht ganz klar. Meines 
Wissens kann Altera Quartus EDIF Netzlisten einlesen (sofern diese mit 
der korrekten Synthesebiblioithek erstellt wurden), aber nicht ausgeben. 
Für das "Extrahieren der Ports", was auch immer das sein soll, kannst Du 
jedenfalls nicht auf EDIF setzen. Vielleicht erklärst Du ja mal, was Du 
eigentlich machen willst.

Grüße,
Harald

Autor: Jim G. (jim34)
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Ich will aus einer Altera Megacorefunction (Cordic) eine Netzliste (EDIF 
File) generieren, damit ich diese in Altium Designer in einer Library 
hinzufügen kann.

Autor: Harald Flügel (hfl)
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Puh, da hast Du dir aber was vorgenommen! Ich kenn den Altium Designer 
nur vom Namen her. EDIF bekommst Du jedenfslls nicht aus Quartus raus. 
Vielleicht geht es ja mit Verilog oder VHDL. Der MegaWizard erzeugt doch 
lesbaren Verilog/VHDL-Modelle, sofern es sich nicht um lizenzpflichtige 
IP handelt.

Autor: Jim G. (jim34)
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Harald Flügel schrieb:
> Der MegaWizard erzeugt doch
> lesbaren Verilog/VHDL-Modelle, sofern es sich nicht um lizenzpflichtige
> IP handelt.

Da hast du Recht, aber von bestimmten IPs kann dann nicht mehr auf die 
Bibliotheken, die zusätzlich zum Quartus Projekt hinzugefügt werden, 
zugegriffen werden.

Mit dem Altium Designer würde sich aus einem EDIF File einfach ein 
eigenständiger Core generieren lassen, der alle anderen Probleme 
beseitigt. Werde dann wohl auf den Altium Support warten müssen.

Trotzdem Danke für deine Hilfe.

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