Cannot open file 'meminitfile'.

Gast #2131020
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Liebe Kollegen!

Ich habe ein Design im System Generator (13.1 und 12.4) gemacht und 
versuche jetzt das ganze in der ISE (13.1 und 12.4) zu simulieren.

Leider bekomme ich folgende Fehlermeldung. Ich finde im Netz nichts und 
die Datei kann ich auch nicht finden. Kann mir jemand helfen?


Starting static elaboration

ERROR:HDLCompiler:1030 - 
"N:/O.40d/rtf/vhdl/src/XilinxCoreLib/dist_mem_gen_v6_1.vhd" Line 210: 
Cannot open file 'meminitfile'.

ERROR:Simulator:777 - Static elaboration of top level VHDL design unit 
top_top_sch_tb in library work failed


Danke!
Sandy
Gast #2131488
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"N:/O.40d/rtf/vhdl/src/XilinxCoreLib/dist_mem_gen_v6_1.vhd"
dürfte der Entwicklungspfad des Xilinx-Programmierers sein :-)

Ich vermute mal, daß bei der Instanziierung von "dist_mem_gen_v6_1"
dort der Generic "c_mem_init_file" auf eben diese File/Laufwerk gesetzt 
ist.

Trag' dort den 'richtigen' Pfad ein, uns alles wird gut...
Gast #2131503
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Klingt logisch! Bleibt nur noch die Frage wo der Pfad steht. Im File ist 
er nicht. Ich weis, dass Ihr mir jetzt nicht mehr helfen könnt und ich 
alleine suchen muss.

Danke für die Hilfe!!!

LG
Sandy
#2134034
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Also die Sourcen für dist_mem_gen_v6_1.vhd befinden sich bei mir (ISE 
11.1) im Installationsverzeichis für ISE und dann unter 
ISE\vhdl\src\XilinxCoreLib.
Ich habe leider nur die Quellen von dist_mem_gen_v4_3.vhd, aber es wird 
ein generic "c_mem_init_file" mit einem Filenamen übergeben, das die 
extension "mif" hat.

Suche in den Quellen deiner Simulation, wo die dist_mem_gen_v6_1 
instantiert wird, und schau nach, wie das generic gesetzt wird.
Gast #2134259
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Sorry, jetzt hab ichs verstanden was Du gemeint hast.

Bei mir heist die

c_mem_init_file => "dmg_61_8454c0e92c2c5b88.mif",

das File finde ich auch, hab´s in der ISE zum Projekt gegeben aber es 
kommt immer noch die selbe Fehlermeldung.

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