Xilinx ISE Webpack: Neues Projekt, Dateibaum erstellen

Gast #2448799
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Hi,

meine Frage mag ein wenig blöd sein, aber ich bin seit ner Stunde dran 
und finde die Lösung nicht. Auch google konnte mir nicht helfen.

Wenn ich im ISE WebPack ein neues Projekt erstelle und dort dann neue 
VHDL-Module hinzufüge, werden die alle mit dem Top-Modul auf einer Ebene 
aufgelistet. Ich weiß aber auch, dass man die in diversen Unterebenen 
gliedern kann, nur leider nicht wie. Wenn mir hier jemand helfen könnte, 
wäre ich sehr dankbar. Außerdem wüsste ich gerne ob das einen 
Unterschied macht, wie ich die im Baum anordne.

thx for help
greez Kiigass
Gast #2448954
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Lothar Miller schrieb:
> So z.B. wie dort auf Seite 15:
> http://www.lothar-miller.de/s9y/uploads/Tutorial_X...
Sehr nett.

Drei kleine Hinweise:
[Seite 16, Typo] In der letzten Zeile ist bei mir ein "a" zuviel.
[Seite 25, Typo] "JTAG Kette" (auch ein a zuviel :)
[Seite 20] Da würde ich nochmal gezielt darauf hinweisen, daß man doch 
bei Unsicherheiten in den Schaltplan/Schematic gucken soll, damit man 
keine Hardware kaputt macht.

Duke

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