Forum: /dev/null CPLD PROJECT MANAGER CLUSTER GRID


von Holger H. (holger-h-hennef) Benutzerseite


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Das ist für el. Bausteine.
http://www.youtube.com/watch?v=-ZriDNJp0fA
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Suche eine Tool-Chain für mein 256 Pinniges CPLD PROJECT.

 *UCF File Tool.

Um die Pinne Und die mannigfaltigen atribute besser managen zu koennen
Ist sowas schon vefügbar.

Stichwort:
CPLD Path analyse
Variblen Namen in Pocedure finden.
Und in Database Listen usw.
Katalog Pipes Koppel+Listen zu anderen CPLD ---CrossBar( CPLD2 )
Doku Status der PIPES also Prozess-Bild-Analyse. Online Tracer..
Retundant Engine_1 .... (n)

Und und und ..[][][][][]Rangier_Verteiler(X1-PUMP-([10:22])--).
Gruss Holger.

Vorschläge bitte.

PIPE COMMAND LANGUAGE
Was geht da noch so..

: Verschoben durch Moderator
von Holger H. (holger-h-hennef) Benutzerseite


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Da is mir noch was eingefallen.
Halt so Eagle Für CPLD Constaint File *.UCF ---Vector[]
#*Routing-Net-List...
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Und Z.B ASCII -DBASE.3.0 like MS ACCESS
+ Visual+Basic via dbf. File als Grid-Tool.
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Oder hier wie diese Text-Box-Mange Prozedure für das Forum.

Group Cut Paste Delete Spam ...Cycle Update Flush ..


Print Doku. Ref & CO.
SWITCH-BORD CONSOLE ADMIN
Doxigen ---@ Doku für TÜV
Internet Online Flight Recorder-Box...@@@Holg.@@Cloud SAT
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F@PROWIN.de

Gruss Holger

von Holger H. (holger-h-hennef) Benutzerseite


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Das ist das JTAG_@PIN_WIN.de
für das Labor, echt gut gemacht.
http://www.youtube.com/watch?v=Rmo1AITLf8c&feature=related


Ich lerne noch daran.
DatenModell und so..


Ich lerne noch daran.
Die Compiler Netliste da zu grabben.

BIT File + CONFIG START_UP. @KERNEL ENGINE []

In Effelsberg am Radio-Teleskop ist schon so was drin
mit COMMAND PIPING SPRACHE für SetUP und Run Management.

z.B Stellwerk .. Bahn ..

Gruss Holger.

von Duke Scarring (Gast)


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Hallo Holger!

Wenn Du es mal mit Grammatik und Satzbau versuchst, versteht man Dich 
vielleicht auch. Und u.U. antwortet sogar jemand. Vielleicht sogar 
konstuktiv.

Holger Harten schrieb:
> Bahn
Ich verstehe bei Deinen "brain farts" nur Bahnhof.

Duke

von Lothar M. (Firma: Titel) (lkmiller) (Moderator) Benutzerseite


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Holger Harten schrieb:
> Suche eine Tool-Chain für mein 256 Pinniges CPLD PROJECT.
Das sind jetzt ja noch nicht allzuviele Pins. Ich habe da duetlich meh 
an den FPGAs...

>  *UCF File Tool.
> Um die Pinne Und die mannigfaltigen atribute besser managen zu koennen
> Ist sowas schon vefügbar.
Ja, das ist der Constraints-Editor.
Oder WAS willst du da managen?

Beschreib mal dein Problem, nicht deine Lösungsansätze...

von unregistered (Gast)


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Sorry das ist einfach nur WIRR in Verbindung mit ein paar Kunstworten 
und Denglisch.
Und das nicht mal mitten in der Nacht.

von Holger H. (holger-h-hennef) Benutzerseite


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BauteileListen in Win-Notepad von 1880
Schau dir mal 10-SPS Systeme mit I/O
Koppel- Listen an…
Alarm Pv Trigger PV /POS/NEG TRISTATE
Diff.-I/O Analog …

Rangier-Bahnhof von Hand schalten.

RadioTeleskop mit parameter Pipe

Mach mal eine Platine mit 10000 Pinnen und fahre die
Per Hand über ein NOTEPAD Netliste. Und Drill-List
Da wird dir aber übel.

Für ein XC9536 ist *ucf ok.

Das muss über DatenBanken laufen, und  gekopplte Listen
Auch für die Doku ist das wichtig.



Hallo,
ich habe mal eine Frage zur Verwaltung von VHDL Files. Ich habe ein
mittlerweile ziemlich umfangreiches Projekt in dem ich knapp 25 VHDL
Files mit genausovielen Modulen eingebunden habe. Langsam habe ich die
Angst, dass ich die Übersicht über das System verliere. Es gibt
bestimmte Teile in dem Projekt die bereits als Einheit abgeschlossen
sind. Ich habe dann die einzelnen Module in einem neuen Modul
zusammengefasst um dieses dann in dem Projekt wieder einzubinden.
Dazu hätte ich jetzt die Frage wie man normalerweise vorgeht wenn man
umfangreiche Projekte hat. Gibt es die Möglichkeit, die Module
zusammenzufassen in einer Art Bibliothek? Oder hat jemand eine Art Style
Guide für mich, wie ich bei umfangreicheren Projekten die Strukturierung
vornehmen kann?
Danke.
Gruss  Holger.

von Holger H. (holger-h-hennef) Benutzerseite


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Verilog Referenzproject geht nicht mehr Compiler spinnt

Ich bin VERILOG Beginner.
Ich kenne  OS9 Level 2
Task Shedduler 68000 Forker Process

Verilog Referenzproject geht nicht mehr Compiler spinnt
und dreht am Rad.
Ich habe mein super kommmentiertes Ref Project zerschossen.
Durch Kommentar oder was ganz trivialem Tipfehler .
Trap ????

 /*####  PUMPE:[1] Signal_clk1PV20MHz   #*/

Ich finde den Fehler nicht, viel auch der Compiler alles auf einen 
schlag
durchmangelt. Und dann #müll## ausspuck.

Einzel übersetzen geht nicht so gut, weil der da am Project-Mgr rumnagt.
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Ich wollte daran trainen, aber auch der Editor r Find in files is recht 
schwierig ..

Dem trau ich so nicht in der Lattice Diamond ed. 1.4xx
Der ist nich so fit wie der von Ms. Visual C  und so clever smarty
 Grab (n_text  ungleich Grab (
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Da fange ich jetzt noch mal von vorne an.

Wie früher die ersten C Compiler, da war das auch so
lauter müll ..... und nur ein ; oder sogar CR hat gereicht dann ging der
wieder.
########################################################################
Was ich auch nicht finde ist die Namen zu verfolgen.

Wie bei C go to defintion, go to referenz geht ja jetz alles.
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--

Ist das was um die signale in EXCEL zu listen.

Ist das was, oder finde ich was besseres.
Doxigen kann kein Verilog.


http://www.docstoc.com/docs/38915770/Verilog-Source-Code-Analysis#

von PittyJ (Gast)


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Also ich schalte meine Rangierbahnhof auch per Hand.
Aber vielleicht sollte man das in einem Modellbahn-Forum diskutieren.

Es gibt hier die Möglichkeit einer Vorschau. Evtl sollte Holger vor dem 
Posten mal lesen, was wirklich in der Text-Box steht.

von Holger H. (holger-h-hennef) Benutzerseite


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So halt mal Buss Bundling ()
Und Doku..

von Holger H. (holger-h-hennef) Benutzerseite


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Bild ging nicht.

von P. K. (pek)


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DFTT ;-)

von Holger H. (holger-h-hennef) Benutzerseite


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Max Freq: Doku to Database .

von Holger H. (holger-h-hennef) Benutzerseite


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Ist so das Modell was ich mir vorstelle.
Bild + ganz unten im pdf.
Sieh unten den EDITOR der ist via Tabelle 10Fach angekoppelt.
und Rangier_Verteiler Horiz/Verttical ...Routing.
/*---------------------------------------------------------*/
Filter:
via Parameter { Liste:[][] }
######################################################################## 
##
Gutes Handling  für das Buss-Bundling[-a-][-b-]->Vector(i/i) und Doku.
/* 
+++++++++++++++++++++++++++++++++++++++++++++++++++++++++++++++++++++*/
Damit man danach das Modell weiter aufbohren und verfeinern kann.
------------------------------------------------------------------------ 
-
Bild (-------)

+ Tabelle [][][]
--> push in *.ucf file. And Compile.

Link:

http://www.cableworld.hu/software/4250Help_a.pdf
Gruss Holger.

von Duke Scarring (Gast)


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@Holger:

Sag mal, was ist das für ein Zeug, was Du da nimmst? Und wo gibt's das? 
Ich will das auch haben!

Duke

von Martin T. (mthomas) (Moderator) Benutzerseite


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Thread hiermit erstmal in /dev/null. Bitte die Vorschläge der 
Antwortenden aufgreifen - am Besten in einem neuen Thread.

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