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Case nur mit Takt möglich?Guten Tag, ich arbeite mich gerade etwas in VHDL ein und versuche einen BCD to 7-Segment Wandler zu simulieren. Die Architektur sieht bei mir so aus:
Wenn ich eine Simulation starte, kommt egal bei welcher BCD Kombination immer der letzte Wert (hier WHEN OTHERS => led_o <= "1111110"; -- 0). Ist so ein Case Konstrukt nur mit einem Takt möglich? Oder warum wird immer der letzte Wert genommen?
Gast
#3129748
Martin S. schrieb: > WAIT; Hm, was genau könnte wohl eine bedingungslose Wait Anweisung machen? Genau, sie wartet bedingungslos, für immer und ewig, auf alle Zeiten, aus, finito... ;-) Dein Prozess wird nur einmal zur Initialisierung ausgeführt und dann nie wieder. Ohne das wait funktioniert das. Auch ohne Takt. Okay, das macht Sinn. Nur wenn ich das WAIT; rauslösche läuft die Simulation ohne Ende und ich bekomm beim kompilieren die Meldung: Possible infinite loop: Process contains no WAIT statement. Wie kann ich das noch beheben? Es muss also auf jeden Fall irgendwo ein wait eingebaut werden oder?
Gast
#3129780
Martin S. schrieb: > Okay, das macht Sinn. Nur wenn ich das WAIT; rauslösche läuft die > Simulation ohne Ende und ich bekomm beim kompilieren die Meldung: > Possible infinite loop: Process contains no WAIT statement. > Wie kann ich das noch beheben? Es muss also auf jeden Fall irgendwo ein > wait eingebaut werden oder? oder dem process eine Sensitivityliste mitgeben, so dass er in der Simulation nur ausgeführt wird wenn sich ein Signal ändert.
Gast
#3129781
Nein, dir fehlt nur die sensitivity list. Das kommt dann bcd_i rein, und dann ist Ruhe im Karton, ähm, der Simulation... Ja Wahnsinn, es funktioniert, danke :D Aber nochmal zur Erklärung, wenn sich bcd_i ändert, dann wird in der Liste geschaut was zu tun ist. Ansonsten wird einfach nichts gemacht (abgewartet?). Hab ich das so richtig verstanden? Martin S. schrieb: > Aber nochmal zur Erklärung, wenn sich bcd_i ändert, dann wird in der > Liste geschaut was zu tun ist. Aber nur im Simulator. Auf der Hardware passiert immer was. Da sind das einfach ein paar Logik-Verknüpfungen.
Gast
#3129850
Ja genau, so ist es. Antwort schreibenBitte melde dich an, um einen Beitrag zu schreiben. |
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