Gast
#3429665
Morgen zusammen Ich beginne seit kurzem mit CPLD von lattice. Es handelt um obsolente ispLSI 1024 (die bei mir über 10 stück rumliegen) soweit es alles gut mit UUND , OR und NOT (auch mit NOR, NAND) hat es gut geklappt. Man staunt nicht schlecht ihre schnelles Anstiegszeit. Sobald es mit Flipflop anfangen, da streikt alles (egal ob Zähler, Schieberegister und co) Selbst diskrete Flopflop mit NAND geht auch nicht. Programm: isplever 17. schematic/Abel oder schematic/VHDL Programmer, USB Programmer Hatte ich da etwas Kleinigkeit mit Sachen beim Flipflop übersehen? Hängt da Sachen mit Register oder constraints Editor? Bin noch nicht so erfahren in Sachen von CPLD, vorher hatte ich öfter mit TTL gebastelt und damit gut ausgekommt.. Grüss Matt