ATMEGA2560 adc im differential mode

Ralf Gast #4272926
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Hallo,

ich möchte den Analogwandler des ATmega2560, im differential Mode, 
nutzen. Leider verstehe aber an einigen Stellen das Datenblatt nicht.


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2,7V – Vcc Differential ADC Voltage Range (Features)


Wie interpretiere ich den genannten Messbereich richtig? Ich möchte zum 
Beispiel Vcc als Referenzspannug hernehmen und den negativen Eingang auf 
+2,5V klemmen. Der positive Eingang kann, bezogen auf GND, zwischen 0V 
und 5V schwanken. Das würde ja differenziell betrachtet -2,5 V bzw. 2,5 
V entsprechen. Aber wieso kann ich nur 2,7 V bis VCC messen?


1
The 16 channels are split in two sections of 8 channels where in each section seven differential analog input channels share a common negative terminal (ADC1/ADC9), while any other ADC input in that section can be selected as the positive input. (Seite 268)


Wie bekomme ich diese Aussage jetzt in die Tabelle zu den 
Multiplexer-Bits übertragen (siehe Anhang)? Die Tabelle verstehe ich so, 
dass nahezu jeder Eingang miteinander verknüpfbar ist.


1
The result from the extended conversions will be valid. See “Prescaling and Conversion Timing” on page 271 for timing details. (Seite 273)


Was genau is diese extended conversion? Enspricht das der First 
conversion und dauert entsprechend 25 cycles? Wenn das so ist, dauert 
die Messung dann nur länger, oder werden hier auch zwei Messungen 
durchgeführt, von denen die erste zu verwerfen ist?

Vielen Dank
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Karl H. #4272955
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LIes ein bisschen mehr als nur die Summary am Kapitel-Anfang und die 
Einleitung. Dann wird vieles klarer.

> Wie bekomme ich diese Aussage jetzt in die Tabelle zu den
> Multiplexer-Bits übertragen (siehe Anhang)? Die Tabelle verstehe ich so,
> dass nahezu jeder Eingang miteinander verknüpfbar ist.

Prosa ist Schall und Rauch.
Was zählt ist die im Abschnitt "Register Summary" angegebene Bit Tabelle 
für die Multiplexer Bits. Dort sind alle Kombinationen aufgeführt, die 
möglich sind.
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Karl H. #4272965
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> Enspricht das der First conversion und dauert entsprechend 25 cycles?

Auch wenn Atmel diesen Begriff nicht näher definiert, würde ich deine 
Frage mit 'Ja' beantworten.

und zwar deshalb:
> By disabling and then re-enabling the ADC between each conversion
> (writing ADEN in ADCSRA to “0” then to “1”), only extended conversions
> are performed.
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Jörg W. Moderator Persönliche Seite #4272974
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Karl H. schrieb:
> Auch wenn Atmel diesen Begriff nicht näher definiert

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Analog to Digital Converter

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      If enabled, the ADC will be enabled in all sleep modes. To save power, the ADC should

4
      be disabled before entering any sleep mode. When the ADC is turned off and on again,

5
      the next conversion will be an extended conversion. [...]


Finde ich „definiert“ genug.
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Karl H. #4272987
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Jörg W. schrieb:
> Karl H. schrieb:
>> Auch wenn Atmel diesen Begriff nicht näher definiert
>
>
1
> Analog to Digital Converter

2
> 

3
>       If enabled, the ADC will be enabled in all sleep modes. To save 

4
> power, the ADC should

5
>       be disabled before entering any sleep mode. When the ADC is turned 

6
> off and on again,

7
>       the next conversion will be an extended conversion. [...]

8
>

>
> Finde ich „definiert“ genug.

Kann man so oder so sehen.
Ich hätte das so gelesen, dass nach einem Aus-Ein ein extended 
conversion gemacht wird.
Das erklärt ja immer noch nicht, was das Wesen einer extended conversion 
ist, wodurch sich die von einer 'normal conversion' unterscheidet.

Mit 'extended' ist wohl die Anzahl der Taktzyklen gemeint, auch wenn das 
in dieser Form nirgends steht.
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