Hallo Leute, ich suche nach einem guten Buch, welches beim Umstieg von Verilog nach SystemVerilog hilft. Kann jemand einen Tipp geben? Allgemein scheint mir, es werden viele Buecher ueber SystemVerilog als tool fuer die Verifikation geschrieben. Ganze Buecher nur ueber SV assertions... Aber fuer den Einsatz im Digial-Design gibt es recht wenig. Schon gar nichts Preiswertes. Andi
isbn 0-387-33399-1 Kostet aber ein Schweinsgeld.
Noro S. schrieb: > http://sutherland-hdl.com/papers/2013-SNUG-SV_Synthesizable-SystemVerilog_paper.pdf Danke! Das Paper ist in der Tat lesenswert. Alleine schon der Titel: "Busting the Myth that SystemVerilog is only for Verification" :-)
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