VHDL Configuration

Neuling Gast #5770615 
Hallo Liebe gemeinde,

Ich habe in den vergangen Tagen ein paar Fragen gestellt zum Thema VHDL 
und ihr habt mir sehr geholfen. Eine Frage ist dennoch übrig geblieben. 
Es geht um den Befehl "Configuration". Egal welche Quelle ich benutze, 
ich verstehe den Sinn und Zweck bzw. das Grundlegende Verständnis dieses 
Befehls ist mir völlig unklar. Könnt ihr mir dort weiterhelfen?
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Code Spasti Gast #5770644 
Neuling schrieb:
> Ich habe in den vergangen Tagen ein paar Fragen gestellt zum Thema VHDL
> und ihr habt mir sehr geholfen. Eine Frage ist dennoch übrig geblieben.
> Es geht um den Befehl "Configuration". Egal welche Quelle ich benutze,
> ich verstehe den Sinn und Zweck bzw. das Grundlegende Verständnis dieses
> Befehls ist mir völlig unklar. Könnt ihr mir dort weiterhelfen?

Das ist ganz simple, wenn du nicht weisst wozu du es benutzen könntest, 
dann brauchst du das auch nicht.


Wahrscheinlich fehlt dir das Grundverständis von Gleiches Interface für 
unterschiedliche Abstraktionslevel. Mittels einer bei Simulationsstart 
gelesenen Configuration, kann man einer entity unterschiedliche 
architectures zuordnen. Wobei nicht jedes synthesetool das unterstützt.

Wird hier öfters durchgekaut:
https://www.google.com/search?lr=&hl=de&as_qdr=all&ei=akiKXMrXN4newAKbjbOoCA&q=VHDL+configuration+site%3Amikrocontroller.net&oq=VHDL+configuration+site%3Amikrocontroller.net&gs_l=psy-ab.3...15276.15276..16042...0.0..0.52.52.1......0....1..gws-wiz.B1FTRjX6zVg
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