Forum: FPGA, VHDL & Co. Zähleraufgabe ohne sinn?


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von LogikLogik (Gast)


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Hallo zusammen,

hab hier eine Übungsaufgabe wo die Signale eingetragen werden sollen. 
Ich sitz jetzt schon ein weile davor und bekomm nix anständiges hin. Da 
alle J und K Eingänge frei liegen, kann ich ja von "speichern" ausgehen. 
also hab ich nur den Reset der Glieder

Ich glaub hier fehlt in der Angabe die Beschaltung der JK (immer 1 oder 
so)

Kann ein geübter nen blick drauf werfen und mir einen Denkanstoss geben?

vielen Dank schonmal

von Georg M. (g_m)


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LogikLogik schrieb:
> Ich glaub hier fehlt in der Angabe die Beschaltung der JK (immer 1 oder
> so)

Ja, J=1, K=1: Toggle-Flip-Flop.

von Lothar M. (lkmiller) (Moderator) Benutzerseite


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LogikLogik schrieb:
> Ich glaub hier fehlt in der Angabe die Beschaltung der JK
Das fehlt tatsächlich, wenn es nicht im Textteil steht, der sicherlich 
vor 30 Jahren beim Original der Kopie von der kopierten Kopie der Kopie 
dabei war.

> immer 1
Nur das wird sinnvolle Ergebnisse mit sich bringen.

: Bearbeitet durch Moderator
von LogikLogik (Gast)


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Vielen Dank,

hab schon an mir gezweifelt :-)

schönen Tag noch allen...

von uwe (Gast)


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Wahrscheinlich TTL Logik... Nicht angeschlossene Eingänge sind logisch H

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