Forum: FPGA, VHDL & Co. Power Up Sequenz bei Xilinx Coolrunner-II


Power Up Sequenz bei Xilinx Coolrunner-II
von Nils Stahlhut (Gast)

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Hallo Leute,

was die Programmierung von CPLDs an geht bin ich noch etwas neu. Ich 
habe das Problem das beim hochlaufen der Betriebsspannung an einem 
Ausgang der eigentlich low sein sollte, so lange ein Spannungsimpuls 
abgegeben wird bis das Niveau der Betriebsspannung erreicht ist.

Verwendet wird ein XC2C256 und als Software die ISE 9.2i

Gibt es eine Möglichkeit dieses Verhalten während der Power-Up-Sequenz 
zu unterbinden?

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Re: Power Up Sequenz bei Xilinx Coolrunner-II
von Rick Dangerus (Gast)

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Hilft ein externer Pull-down?

Rick

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