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Forum: FPGA, VHDL & Co. Timing für auslesen der Pixelwerte für PAL Signal


Autor: Gast (Gast)
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Hallo,

ich erzeuge mit einem FPGA die PAL-Signale. Jetzt habe ich aber das 
Problem, dass das erzeugte Testbild leider nur verkrisselt ist. ICh will 
eigentlich nur ein grünes Testbild erzeugen. Wie muss ich denn das 
Auslesen des Zeilen Buffer timen, so dass die Pixelwerte zur richtigen 
Zeit ausgelesen werden. Momentan starte ich den Auslesecounter wenn 
derBlankimpuls (front Porch, Back Porch + H_sync).
Aber das scheint nicht ganz richtig zu sein. Kann mir da jemand weiter 
helfen????

DANKE

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> ich erzeuge mit einem FPGA die PAL-Signale...
> ...dass das erzeugte Testbild leider nur verkrisselt ist.
Welche Hardware (FPGA-Hersteller/Typ; DAC Herstller/Typ)verwendest du?
Beschreibe doch bitte deinen Aufbau etwas genauer.
Und/Oder mal eine kleine Skizze.
Und/Oder poste den Quellcode...

Autor: Gast (Gast)
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ICh verwende ein Virtex 4 ENtw. Board ML402, Video DAC ADV7125.
Ich generiere das Horizontal und Vertikaltiming in einem System 
Generator Model.

Autor: Bernd G. (Gast)
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Kennst du die Xilinx AppNote 514?
Da steht alles lang und breit zu digitalem Audio und Video drin. Auch 
die Timing-Infos zu PAL und NTSC (Vorsicht: Zeilen werden in PAL und 
NTSC verschieden gezählt!).

Autor: Gast (Gast)
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Wo finde ich denn die APP Note 514???
 Bei Xilinx habe ich die nicht gefunden.

Autor: Anonymous (Gast)
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Ing.s die keine Appnotes finden können.... :-(

http://www.xilinx.com/support/documentation/applic...

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