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"State"Anzeige in einer Testbench
Gast
#1292035
Hi -
würde gerne in meiner Testbench als Text anzeigen, welchen Test ich
gerade durchführe.
Habe es derzeit mit
write(state,string'("modul im reset"));
.. diese Variable kann ich aber in der Testbench nicht tracen.
Kann mir da Jemand weiterhelfen?
Danke,
Gabriel
Wenn du deinen States selber Namen gibst erscheinen diese Auch in der Simulation.
Gast
#1292100
Danke. Bei einer statemachine, ich weiss.. aber wie mache ich sowas: entity top_tb is end top_tb; architecture behaviour of top_tb is component xy.. port(.. ); end component; signal xy.. begin uut: xy port map( ); stim_proc: process RESETN <= '0'; wait for 100 ns; RESETN <= '1'; .. .. ####hier möchte ich als signal / info wie auch immer einen string schreiben können, so dass ich im Simulationsfenster sehe, welcher test gerade ausgeführt wird#### .. .. begin end process; end ;
Gast
#1292185
Abhängig davon welchen Simulator du benutzt: mit assert(...) gibts eine Konsolenausgabe. assert nutzen:
In einer Testbench verwende ich auch ganz gerne das:
Dabei ist zu beachhten das der String auch 10 Zeichen hat.
Gast
#1292329
Danke - das habe ich gesucht!! Grüße
Gast
#1292355
schade - in modelsim wird das signal text wohl rausoptimiert. das signal steht nicht zum tracen zur verfügung.
Gast
#1292466
Da sollte eigentlich nix rausoptimiert werden. Zeig mal deinen Code. Ansonsten, was ist mit der assert-Anweisung? Mit assert false report "wasauchimmer" severity note; sollte es klappen. Hm???? Wüsste nicht das in einer TESTBENCH was "rausoptimiert" wird. Da gibt es nichts zu optimieren. Der code gehört in die Testbench, sicher das du es da rein geschrieben hast? und nicht vielleicht in deinen eigentlichen Code?
Gast
#1292673
Gfs hat er eine Variable benutzt. Antwort schreiben |
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