Forum: FPGA, VHDL & Co. convertieren


convertieren
von Mari G. (mariaa)

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hallo ,
ich habe eine problem mit datentyp ,ich will integer in
std_ulogic_vector umwandlen .ich habe das so gemacht:

........
port( d: std_ulogic_vector( 0 to 7);
.........
);

........
..........

Signal A :integer ;
.....
d(0 to 7)<=conv_std_logic_vector(A,Bits);

aber leider funktioniert nicht weil  A unterschiedliche werte nehmen
soll.

habe ich   das so falsch gemacht?
danke schön.

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Re: convertieren
von Duke Scarring (Gast)

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Siehe hier:

http://dz.ee.ethz.ch/support/ic/hdl/vhdlsources.en.html

Duke

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