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Forum: FPGA, VHDL & Co. Variablen und Reset


Autor: horst. (Gast)
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Hi,

habe mal eine grundlegende Frage zum Reset von Variablen in einem 
getakteten Prozess, da ich hier oft unterschiedliche Meinungen höre. Wie 
handhabt ihr das, Reset für Variablen, ja oder nein? Das Variablen vor 
dem Lesen geschrieben werden sollen (Latch-Vermeidung) ist klar.

MFG,
horst.

Autor: Thomas Reinemann (Firma: abaxor engineering) (abaxor)
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Hallo,

was braucht einen Reset:
-Zustand einer FSM, dazu gehöhren auch Counter, wenn sie außerhalb einer 
FSM verwendet werden
-Ausgangsignale

Für beides verwendet man keine Variablen, also brauchst du Variablen 
auch nicht reseten.

Wenn du eine Variable in dem Sinn verwendest, für den sie in VHDL 
eingeführt wurde, braucht sie keinen Reset. Wenn du sie als lokales 
Signal missbrauchst, dann brauchst du u.U. ein Reset/Initialisierung.

Tom

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> Reset für Variablen
Um etwas zurücksetzen zu können, muß es speichernd sein. Und genau das 
ist bei Variablen recht unhandlich. Ein einfaches Beispiel war im 
Beitrag "Re: Beschreibung einer State Machine"
Dort kam die Problematik mit dem Lesen vor den Schreiben auf den Tisch.

Wenn jetzt eine Variable aber immer zuerst geschrieben wird, dann 
erübrigt sich ein Reset...

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