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Forum: FPGA, VHDL & Co. Mehrere Generics, geht das?


Autor: Jens B. (sio2)
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Hi, ich würde gerne mehrere Generics nutzen, aber xst meckert
"Line 33. parse error, unexpected GENERIC, expecting END"
Bei folgendem Code:

entity pwm is
generic(wth: positive := 64);

generic(width : positive :=3*9);

    Port ( clock : in  STD_LOGIC :='0';
              spi_en : in  STD_LOGIC;
        spi_data: in std_logic;
        spi_clock : in std_logic;
        reset : in std_logic;
        led : out std_logic_vector(width-1 downto 0);

          AWAKE : inout std_logic :='0' ); -- led awake

end pwm;

Geht das mehrere Generics zu verwenden, wenn ja wie?  Eigentlich sollte 
das gehen.

Autor: user (Gast)
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entity pwm is
generic(wth: positive := 64;
width : positive :=3*9);

    Port ( clock : in  STD_LOGIC :='0';
              spi_en : in  STD_LOGIC;
        spi_data: in std_logic;
        spi_clock : in std_logic;
        reset : in std_logic;
        led : out std_logic_vector(width-1 downto 0);

          AWAKE : inout std_logic :='0' ); -- led awake

end pwm;

so sollte es gehen, generics werden wie ports behandelt :)

Autor: Jens B. (sio2)
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Danke. Alle Beispiele die ich gefunden habe , hatten nur 1 generic drin. 
Und auf diese idee bin ich nicht gekommen, obwohl es logisch wäre.

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