Ich habe eine Frage, die ich mir nicht selber beantworten kann. Muss zugeben, dass ich noch nicht sehr viel über FPGA und dgl. weis. Wiso behält ein CPLD seine Programmierung und ein FPGA nich? Danke!!! Hannes
FPGAs sind SRAM-basiert, verlieren also ihren Inhalt bei Ausbleiben der Versorgungsspannung. CPLDS sind EEPROM-basiert und sind somit nichtflüchtig. Steht auch alles in Wikipedia oder hier im Wiki
> Wiso behält ein CPLD seine Programmierung und ein FPGA nich? Spartan 3AN FPGAs enthalten auch den Config Speicher. > Wiso behält ein CPLD seine Programmierung und ein FPGA nich? Deine Frage ist in etwa so zu vergleichen: Wieso haben Fahrräder nur 2 Räder und Autos 4? Antwort: weil sie unterschiedliche Herkunft und Zielgruppen haben. CPLDs kommen aus der GAL-Ecke. Da war es traditionell so, dass die ihre Konfiguration selbst gespeichert haben. Heutzutage werden CPLDs übrigens auch geladen. Allerdings geht das so schnell, dass man das nicht merkt... FPGAs waren ursprünglich anders aufgebaut (wie SRAM) und haben ihre Konfiguration ohne Strom vergessen. Deshalb musste extern irgendein Lade-Mechanismus angeflanscht werden.
Es gibt auch FPGAs, die die Programmierung behalten. Neuere CPLDs heissen nur noch "CPLDs" und es sind FPGAs drin
Der wesentlich Unterschied, neben dem speicher ist die Groesse in anzahl Flipflop Zellen. Ein CPLD ist bei 1000 Makrozellen langsam fertig, FPGAs beginnen da etwa und gehen bis MegaZellen.
Ein CPLD ist in vielen Fällen schneller, da die Makrozelle viel breiter ist und somit weniger LogicEbenen verbraucht werden. Mit einer Makrozelle kann oft die Funktion von mehreren LEs (bzw CLBs=) ersetzen. Die Makrozellen-Anzahl kann nicht mit der LE- oder CLB-Anzahl vergleichen. Die Hersteller geben da immer manipulierte Werte an, die in Richtung neuerer Bausteine gehen. Bei Makrozellen(-PLDs) steigt der Verdrahtungsaufwand quadratisch mit der Makrozellen-Anzahl, weshalb diese Bausteine bei hohen MAC-Anzahl rel teuer sind.
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