Hallo, 1. kostet der fifo core generator eigentlich etwas. Auf der Homepage von xilinx steht end user license. Wo kann man das Ding bekommen? 2. Hab selbst schon einen FIFO mit vhdl im Studium erstellt, jedoch könnnen bei schnelle Taktraten Fehler entstehen. Dort sind 2 Synchronisations FFs drin um den metastabilen Zustand zu verhindern. Kennt jemand noch welche Maßnahmen um die Funktionalität zu verbessern? Spezielle Zähler verwenden? Viele Grüße
Ok, müsste man bei der Verwedenung dieses Cores für die full und empty Signale jetzt noch die beiden synchronisier flip flops selbstständig einbauen, oder sind sie dort schon enthalten? Im Datenblatt finde ich hierzu keine Bemerkungen
Wenn du einen FIFO aus dem CoreGen nimmst, brauchst du dir da keine Gedanken zu machen, das ist alles auf den jeweiligen Takt synchronisiert. In der Regel wird sowas intern mit Graycode-Zählern gemacht. Aber beim FIFO Core kommen die Status-Signale entsprechend synchron zum jeweiligen Takt raus.
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