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Forum: FPGA, VHDL & Co. Multiplexer aus std_logic


Autor: Fandango (Gast)
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Ich habe eine Multiplexer Beschreibung folgender Art gefunden:
(...)

 CASE sel IS
    WHEN  "00"  =>  output <= in0;
    WHEN  "01"  =>  output <= in1;
    WHEN  "10"  =>  output <= in2;
    WHEN  "11"  =>  output <= in3;
    WHEN OTHERS =>  output <= 'X';
  END CASE;
(...)

Meine Frage ist nach dem when others. Macht eine solche Beschreibung 
Sinn, oder wäre es aureichend when "11" durch when others zu ersetzen?

schöne grüße

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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    WHEN  "00"  =>  output <= in0;
    WHEN  "01"  =>  output <= in1;
    WHEN  "10"  =>  output <= in2;
    WHEN  "11"  =>  output <= in3;
Das sind nur 4 Fälle von 81 möglichen...
Denn std_logic ist eine 9-wertige Logik und deshalb müssten solche Fälle 
wie "0L" "1U" "XH" "LZ"... auch abgefragt werden. Das macht der /when 
others/.

> Macht eine solche Beschreibung Sinn,
Für die Simulation ist deine Beschreibung also besser, denn dann wird 
für diese restlichen 79 Zustände der Wert 'X' zurückgegeben.

> oder wäre es aureichend when "11" durch when others zu ersetzen?
In der synthetisierten Hardware gibt es aber nur '0' und '1', deshalb 
werden dort beide Lösungen das selbe Ergebnis bringen.

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