Forum: FPGA, VHDL & Co. ModelSim - Testbench


ModelSim - Testbench
von new (Gast)

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Hallo,

ich habe zu einem VHDL-Programm eine Testbench geschrieben.
Diese habe ich mit ModelSim bereits simuliert.
Im "ModelSim-Wave-Fenster" werden mir nur die Verläufe der Signale der 
Testbench angezeigt. Deshalb meine Frage:
Ist es möglich auch die Ein- und Ausgänge, sowie die Signale des zu 
testenden VHDL-Programms anzuzeigen? Wenn ja, wie?

Danke!

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Re: ModelSim - Testbench
von P. K. (pek)

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Du selektierst im Workspace-Fenster (sim-Tab) die ensprechende 
Hierarchie, im Objects-Fenster das/die gewünschte(n) Signal(e) und 
ziehst sie ins Wave-Fenster...

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Re: ModelSim - Testbench
von new (Gast)

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Unter "sim" wird bei mir leider nur das File der Testbench angezeigt!

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Re: ModelSim - Testbench
von new (Gast)

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Oh, tut mir leid. Hab es gefunden. Vielen Dank!

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Re: ModelSim - Testbench
von Hans (Gast)

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1.Beitrag: Datum: 12.10.2011 16:01
2.Beitrag: Datum: 12.10.2011 16:12

Vielleicht sollte man einfach mal 10 Mnuten lang das Gehirn rattern 
lassen!

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