Optimale Clock (bzw. Clock Divider) für Timer?

OP #3160179
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Hallo Boardies,

ich nehme gerade bei meinem Mikrocontroller (NXP LPC1769) den Timer0 in 
Betrieb. Ich kann dort unter anderem konfigurieren mit welcher Clock 
(Frequenz) der Timer gespeist wird. Diese ist abgeleitet von der CPU 
Clock (CCLK). Basierend auf der CCLK kann ich einen Divider einstellen 
(1, 2, 4) für meinen Timer.

Ich habe ein Stück Beispiel-Code für die Timer-Konfiguration. Dort wird 
ein Divider von 1 (sprich Timer-Clock = CCLK) verwendet. Die 
Treiber-Library, die von NXP zur Verfügung gestellt wird und unter 
anderem eine Initialisierungs-Funktion für die Konfiguration des Timers 
verwendet, nutzt hingegen (fest codiert) einen Divider von 4.

Ich habe nun schon ein bisschen herumgespielt, konnte aber noch 
herausfinden, anhand welcher Kriterien ich mich für einen Divider von 1, 
2 oder 4 entscheiden sollte. Im Manual des LPC1769 steht leider auch 
nicht dazu.

Kann mir jemand einen Tip geben?

Danke und Grüße,
ferraith
OP #3160215
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@ Linüx
Ganz verstanden habe ich es leider noch nicht. Am Besten ist es wohl ich 
gebe ein Beispiel:
Ich habe den PrescaleValue des Timers (PR-Register) auf 12000 eingesellt 
(zehntausendstel der CPU-Takt-Frequenz. Meine CPU Clock liegt bei 120 
Mhz.

Nach welcher Zeit würde nun mein Timer überlaufen, bei einem Dividier 
von 1 und bei einem Divider von 4?
Ist ein Überlauf problematisch? Im Regelfall läuft doch ein Timer immer 
irgendwann über. Das sollte doch keine Auswirkung auf das Zählverhalten 
haben oder?

@Hmm
Geh bitte wo anders trollen.
Gast #3160243
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A. S. schrieb:

> Ich habe nun schon ein bisschen herumgespielt, konnte aber noch
> herausfinden, anhand welcher Kriterien ich mich für einen Divider von 1,
> 2 oder 4 entscheiden sollte.

Tja, Erkenntnisse gewinnt man nicht durch herumspielen, jedenfalls nicht 
durch herumspielen allein.

Nachdenken hilft da schon eher.

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