Bereiche Auskommentieren in VHDL

Gast #251335
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Hi...
Gibt es eigendlich gar keine alternative in VHDL um ganze bereiche
auszukommentieren zu -- ??
Ich mine eine möglichkeit wie in C mit /* und */ zu arbeiten?
Ich kann absolut nichts in der richtung finden. Wenn nicht, wär das
doch mal nen anlass die VHDL 93 Spezifikation zu Pimpen :-)
Gast #251336
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Moin...

bitte was willst du mit der VHDL93 machen?

Ansonsten: Nein, kein Bereichskommentar. Xilinx stellt das seit der V7
nach, die Bereichskommentar Funktion knallt aber vor jede Zeile ein
"--"

--
 Sven Johannes
Gast #251339
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Version 7 des Webpacks von Xilinx. Da hat man nun nen button der vor
jede Zeile die auskommentiert werden soll ein "--" macht.
Hmmm XEmacs... das kenne ich gar nicht... da muss ich mal schauen.
Gast #251342
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Äh?
Grauenvoll? Bitte? Reden wir vom selben Ding? Xemacs ist genau das, was
jemand, der viel programmiert, braucht! Webpack ist total
überdimensioniert für Simulation und den ganzen Kram. Verstehe gar
nicht, wie man damit vernünftig arbeiten kann :-o

Mit xemacs wird auf einen Tasten Druck alles kompilliert, Fehler
angezeigt. In Modelsim dann restarten und schon geht es los. Und
WebPack, na ja...

Ok, gebe zu, ich programmiere sowohl Altera, als auch Xilinx, da bleibt
mir nichts übrig - möchte halt irgendwas haben, worauf ich mich
einschissen kann. Und xemacs ist dieses! Gebe zu, dass da ein Paar
Sachen nicht so funktionieren, aber sonst? Wenn man noch
Windows-Tastaturbelegung dafür installiert, ist alles voll schick
(nutze zwar nicht, aber egal)

So... also nichts mit grauenvoll :-) ;-) Schön aber zu hören, dass
andere nicht darauf stehen ;-)... Schon allein => oder <= zu tippen,
geht mit XEmacs viel eleganter und schneller :-o Ihr müsst natürlich
vhdl-Pack installieren, sonst hat das, was ich oben geschrieben habe,
wenig Sinn

Gruß

Konstantin

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